一种高吞吐率国密SM3硬件IP核的设计与实现

发布时间：2018-04-15 01:33

  本文选题：信息安全 + 国密SM　； 参考：《电子器件》2017年03期

【摘要】：为满足网络安全认证的需求,提出了一种高吞吐率的国密SM3的硬件IP核的设计方法。该方法用3级流水线缩短了每轮运算的关键路径,提升了系统时钟,并将64轮运算全部展开,实现轮间64级流水线,总共192级的全流水线设计,能够同时实现192组消息的SM3运算。基于SMIC 0.18μm的工艺,实现了该IP核,时钟频率达到了200 MHz,吞吐率达到了102.4 Gbit/s,比现有的研究成果提升39.3%。
[Abstract]:In order to meet the requirement of network security authentication, a design method of hardware IP core of Guomai SM3 with high throughput is proposed.In this method, the critical path of each operation is shortened by pipeline of level 3, the system clock is raised, and 64 rounds of operation are fully expanded to realize the design of a complete pipeline with a total of 192 levels.The SM3 operation of 192 groups of messages can be implemented at the same time.Based on the SMIC 0.18 渭 m process, the IP core is realized. The clock frequency reaches 200MHz and the throughput reaches 102.4 Gbit / s, which is 39.3% higher than the existing research results.
【作者单位】： 贵阳学院电子与通信工程学院;安全互联实验室;
【基金】：国家自然科学基金青年项目(11605030) 贵州省联合基金项目(黔科合J字LKG[2013]40号);贵州省联合基金项目(黔科合J字LKG[2013]41号)
【分类号】：TP393.08

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本文编号：1751946