高性能CIC滤波器的优化设计

发布时间：2017-10-16 12:40

  本文关键词：高性能CIC滤波器的优化设计

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【摘要】：在双相相敏检测技术的数字锁相放大器系统中,为了解决被测信号的采样频率较高造成的数字信号处理系统响应速度慢及占用硬件逻辑资源多的问题,采用多速率信号处理理论来降低被测信号的采样频率。利用级联积分梳状(CIC)滤波器实现采样率的降低,提出通过级联内插二阶多项式(ISOP)滤波器降低其通带的衰减。应用Hogenaur"剪除"理论消除来自前一级的低有效位在保证级联积分梳状滤波器滤波特性的同时减少了硬件实现时所占的逻辑资源,改进后的级联积分梳状滤波器可以获得更好的滤波性能。MATLAB与Modelsim联合仿真测试验证了设计的正确性与可行性。
【作者单位】： 南华大学电气工程学院;
【关键词】： 级联积分梳状滤波器 内插二阶多项式滤波器 “剪除”理论
【基金】：湖南省自然科学基金项目资助(2015JJ6098) 南华大学重点学科建设项目资助(NHXK04)
【分类号】：TN713
【正文快照】： 1引言基于FPGA的数字锁相放大器系统是目前微弱信号检测领域较先进的微弱信号检测技术,且随着FPGA技术的快速发展越来越受到人们的青睐。对于较高采样率下的被测信号,要求后续的信号处理系统占用较多的硬件逻辑资源来提高系统性能,否则就会造成信号响应速度过慢或者检测精确度

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本文编号：1042733