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基于NiosⅡ的DDS函数信号发生器

发布时间:2018-05-21 07:21

  本文选题:Nios + Ⅱ软核 ; 参考:《国外电子测量技术》2016年07期


【摘要】:为了减小函数信号发生器的体积,降低函数信号发生器的成本,提出了一种基于Nios Ⅱ的函数信号发生器设计方案。该方案利用硬件描述语言Verilog HDL设计硬件底层模块,并在现场可编辑门阵列(field programmable gate array,FPGA)芯片中嵌入Nios Ⅱ软核处理器作为系统的控制器,采用DDS技术使用软硬件结合的方式产生函数信号。经过试验测试结果表明,该方案可行,能够达到减小体积、降低成本的目的,并且可以产生频率、幅值可调的多种函数信号。整个系统具有较好的扩展性和良好的发展前景。
[Abstract]:In order to reduce the volume of the function signal generator and reduce the cost of the function signal generator, a design scheme of the function signal generator based on Nios II is proposed. The scheme uses the hardware description language Verilog HDL to design the hardware bottom module and embedded Nio in the field editable programmable gate array, FPGA chip. The s II soft core processor is used as the controller of the system and uses the combination of hardware and software of DDS technology to produce the function signal. The test results show that the scheme is feasible and can achieve the purpose of reducing the volume and reducing the cost, and can produce a variety of function signals with frequency and adjustable amplitude. The whole system has good expansibility. And good prospects for development.
【作者单位】: 桂林电子科技大学信息科技学院;
【基金】:2014年广西壮族自治区级大学生创新创业训练计划立项项目(201413644023)资助
【分类号】:TN741

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本文编号:1918279

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