数字集成电路门控时钟可靠性研究

发布时间：2018-05-30 00:44

  本文选题：低功耗设计 + 门控时钟　； 参考：《科学技术创新》2018年07期

【摘要】：在大规模的集成电路设计中,门控时钟技术能够有效的减少功率消耗,由于信号的特点使门控时钟在设计上会出现错误,以及其他问题,为了解决这些问题,将门控时钟的检查和优化技术使用中将门控时钟的风险减少,并且加强电路的稳定性。
[Abstract]:In the large-scale integrated circuit design, the gated clock technology can effectively reduce the power consumption, because of the characteristics of the signal, there will be errors in the design of the gated clock, and other problems, in order to solve these problems, The risk of gating clock is reduced and the stability of circuit is enhanced.
【作者单位】： 贵州航天电子科技有限公司
【分类号】：TN431.2

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本文编号：1953181