一种基于MCML和TSPC的分频器设计
[Abstract]:As a basic module in electronic system, frequency divider is widely used in frequency synthesizer, orthogonal signal generation, clock generation, data recovery and high frequency optical fiber communication system. The working state of frequency divider often becomes one of the bottlenecks of high-speed electronic system, and its characteristics often have a decisive effect on the performance of electronic system. The multimode divider designed in this paper is mainly composed of 9-stage cascade divider 2 / divider 3 units. The main unit of except 2 / 3 module is high speed flip-flop. After considering the requirements of speed, area and power consumption in the design, MOS current mode logic (Mos Current Mode Logic,MCML (Mos Current Mode Logic,MCML) structure is adopted at higher frequency. The true single phase clock (True Single Phase Clock,TSPC) structure is used at lower frequency. In view of the modularization of divided-2 / divide-3 unit, which is easy to optimize power consumption, but the range of divide-frequency ratio is limited, by adding appropriate gate level and output stage circuit, the range of divide-frequency ratio is widened, which can realize high speed. Low power performance index, but also can achieve wide frequency division ratio. Based on the CSMC 0.5m CMOS technology, the working voltage is 2.5V. When the clock signal with input frequency of 0.5GHz~3GHz range is loaded, the Cadence Spectre simulation is used. The simulation results show that the multi-mode divider can be continuously varied and configurable in the range of 128B1023, which meets the design requirements.
【学位授予单位】:贵州大学
【学位级别】:硕士
【学位授予年份】:2015
【分类号】:TN772
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,本文编号:2334192
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