采用1.75 Gbps串行发送器的低功耗14位125 MSPS ADC

发布时间：2019-03-17 10:50

【摘要】：提供了一种适宜于多通道集成的低功耗、小面积14位125 MSPS流水线模数转换器(ADC)。该ADC基于开关电容流水线ADC结构,采用无前端采样保持放大器、4.5位第一级子级电路、电容逐级缩减和电流模串行输出技术设计并实现。各级流水线子级电路中所用运算放大器使用改进的"米勒"补偿技术,在不增加电流的条件下实现了更大带宽,进一步降低了静态功耗;采用1.75 Gbps串行数据发送器,数据输出接口减少到2个。该ADC电路采用0.18μm 1P5M 1.8 V CMOS工艺实现,测试结果表明,该ADC电路在全速采样条件下对于10.1 MHz的输入信号得到的SNR为72.5 d BFS,SFDR为83.1 d B,功耗为241 m W,面积为1.3 mm×4 mm。
[Abstract]:Provides a low power consumption, small area 14-bit 125 MSPS pipelined analog-to-digital converter (ADC). For multichannel integration The ADC is based on switched capacitor pipelined ADC structure. It is designed and implemented by sampling and holding amplifier without front-end sampling and holding amplifier, 4.5bit first stage sub-circuit, step by step reduction of capacitance and serial output of current mode. Using the improved "Hans Muller" compensation technique, the operational amplifiers used in the pipeline sub-circuits at all levels can achieve larger bandwidth without increasing the current, and further reduce the static power consumption. Using 1.75 Gbps serial data transmitter, the data output interface is reduced to 2. The ADC circuit is implemented by 0.18 渭 m 1P5M 1.8V CMOS process. The test results show that the SNR of the ADC circuit for the input signal of 10.1 MHz is 72.5 d BFS,SFDR 83.1 dB and the power consumption is 241MW under the condition of full speed sampling. Area 1.3 mm x 4 mm.
【作者单位】： 中国电子科技集团第五十八研究所;黄山学院信息工程学院;西安电子科技大学微电子学院;
【基金】：国家自然科学基金(61474092)资助项目
【分类号】：TN792

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本文编号：2442223