高效CMOS逐次逼近型模数转换器关键技术研究
【学位授予单位】:西安电子科技大学
【学位级别】:博士
【学位授予年份】:2018
【分类号】:TN792;TN386
【图文】:
. Lee 等人在 2012 年首次提出了一款 2 级的 Pipelined SAR ADC,采样率达s[30]。在 2017 年的时候,德州大学达拉斯分校 H. Huang, H. Xu 等推出了一款m CMOS 工艺的 330MS/s Pipelined SARADC[31],功耗仅有 6.23mW。图1.3 1997-2017 年 ADC 性能发展图
若相邻 DAC 之间的电压误差的取值之差用 DNL 表示,则有以下公式: _ _ _1DAC error DAC error DAC errorDNL y V y V y V y (中,y/2N=Vin/Vref,LSB=Vref/2N。VDAC_error等于 Vref,与理想值相等,因此此时的 INL 应为最小值。当 Sn= V其中 VFS为 ADC 的满摆幅量化电压)时,INL 和 DNL 为最大值。 11 1 1, ,max0 0(2 ) (2 1)2 2NiN N N iDAC error DAC error ref refN NDNL y V V V VC C (那么 DNL 方差为:211 2 1 2 22 1 0 2 0 2 02,max2 2 2 2 20 0 02 (2 1)( ) 22 2 2NN nN NnNDNL ref ref refN N NuE E V V V LSBC C C C (1max ,(2 )NDAC errorINL V (2可以得到:12 22 0 2 1 02,max2 2 20 02( ) 22NNINL refNE V LSBC C (2
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