电力电子硬件在回路仿真系统建模及FPGA资源优化方法的研究

发布时间：2021-11-15 21:43

　　随着电力电子系统开关频率越来越高,基于常规CPU处理器或数字信号处理器等传统仿真器难以满足高频、多开关电力电子系统实时仿真的精度要求。相比之下,FPGA（Field Programmable Gate Array）具有良好的并行数据处理能力、较高的时钟频率,优越的可重配置性和可扩展性,迅速成为电力电子系统实时仿真的首选。电力电子系统建模是影响硬件在回路（Hardware-in-the-loop,简称HIL）实时仿真系统性能的重要因素。由于传统建模方法难以高效地实现高频、多开关电力电子电路的实时仿真,需要提出建模改进方案。同时仿真精度与FPGA资源消耗之间的平衡也十分重要,其中变量字长、仿真步长对模型精度及FPGA资源消耗均有较大影响,但目前缺少详细的定量分析。因此,改进现有建模方法,定量选择满足建模精度要求的最小字长与最佳仿真步长以优化FPGA资源是多开关电力电子系统实时仿真领域的重要问题。本文详细研究、改进了ADC（Associated Discrete Circuit）建模方法与RON/ROFF建模方法,提出了基于信噪比概念的FPGA资源优化策略。本文具体完成了以下工作:（1）以基... 

【文章来源】：北京交通大学北京市 211工程院校 教育部直属院校

【文章页数】：78 页

【学位级别】：硕士

【部分图文】：

图１－１实时仿真与离线仿真的区别??Ｆｉｇ?１－１?Ｔｈｅ?ｄｉｆｆｅｒｅｎｃｅ?ｂｅｔｗｅｅｎ?ｒｅａｌ－ｔｉｍｅ?ｓｉｍｕｌａｔｉｏｎ?ａｎｄ?ｏｆｆｌｉｎｅ?ｓｉｍｕｌａｔｉｏｎ??

图１－２实时仿真示意图??Ｆｉｇ?１－２?Ｒｅａｌ－ｔｉｍｅ?ｓｉｍｕｌａｔｉｏｎ?ｄｉａｇｒａｍ??业（Ｒａｉｄ?Ｐｒｏｔｏｔｉｎ，称ＲＰ）逐渐发展，产生了快??

图２－３?ｓｉＷ的切换状态〇＿／＞０）??Ｆｉｇ２－３?Ｔｈｅ?ｓｗｉｔｃｈ?ｓｔａｔｅ?ｏｆ?ｓｗｌ／／＞０

【参考文献】：
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本文编号：3497547