一种基于FPGA进位链的时间数字转换器

发布时间：2017-06-09 20:02

  本文关键词：一种基于FPGA进位链的时间数字转换器，由笔耕文化传播整理发布。

【摘要】：提出了一种基于Xilinx Virtex-5FPGA的时间数字转换器。利用Virtex-5中专用进位链CARRY4构造的延迟链,对时钟周期进行内插以得到更高精度的测量。此外,运用布局布线约束来减少延迟链的不一致性,降低了微分非线性(DNL)以及积分非线性(INL)。仿真结果表明,最低有效位(LSB)为52.22ps,精度(RMS)约为25ps,INL为0~0.9LSB,DNL为-0.03~0.1LSB。
【作者单位】： 重庆邮电大学光电工程学院/国际半导体学院;
【关键词】： 时间数字转换器 进位链 CARRY 布局布线 可编程逻辑器件
【基金】：国家自然科学基金资助项目(61404019)
【分类号】：TN791
【正文快照】： 1引言时间数字转换器(TDC)是一种用来测量时间的电路,它将携带时间信息的模拟信号转换为数字信号,从而实现时间测量的数字化[1]。它主要应用于飞行时间测量(TOF)、正电子成像技术(PET),以及激光、雷达、示波器等多种科学和工程领域[2]。TDC电路的设计可分为全定制设计(ASIC)和

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本文编号：436507