一种基于FPGA的高可用容错计算机的研究
本文关键词:一种基于FPGA的高可用容错计算机的研究
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【摘要】:针对传统容错嵌入式计算机故障检测方式较少,故障检测实时性不高,并且多余度结构中单个计算节点自身的可靠性较低的问题,给出了一种基于FPGA的高可用容错计算机设计思路。该计算机采用Lock Step技术作为处理器和存储器的故障检测方式,并应用TMR技术和局部重加载技术来提高接口电路FPGA设计的可靠性,具有丰富的故障监测方式,在多层级上增加了故障检测的覆盖率和实时性,显著提高了多余度结构中单个计算节点自身的可靠性,而且具备智能故障管理和故障自恢复能力。
【作者单位】: 中航工业西安航空计算技术研究所;
【关键词】: 容错 嵌入式 Lock Step技术 TMR技术
【分类号】:TP302.8;TN791
【正文快照】: 0引言嵌入式计算机的高可靠性和高可用性对于其在安全关键领域的应用具有非常重要的意义。传统的嵌入式计算机的故障检测主要采用看门狗监测、IO闭环测试等方法来进行,其可靠性的保障主要通过增加计算节点的余度的方式来实现[1]。这些传统的故障检测方式可以达到较高的故障检
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,本文编号:568575
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