基于时钟控制技术的低功耗三值D触发器设计

发布时间：2017-07-29 14:10

本文关键词：基于时钟控制技术的低功耗三值D触发器设计

【摘要】：提出一种低功耗的基于时钟控制技术的三值D触发器(CG-TDFF)。CG-TDFF通过在电路中嵌入时钟控制技术,在输入信号不发生改变时抑制时钟链以减少触发器内部节点的冗余跳变,从而有效地降低电路功耗。基于SMIC65 nm工艺的仿真结果表明,CG-TDFF具有正确的逻辑功能,低功耗特征明显,在开关活动性为10%时,功耗比参考电路下降最高达29.84%。
【作者单位】：浙江大学信息与电子工程学院;
【关键词】：时钟 多值逻辑 时钟控制技术 三值D触发器
【基金】：浙江省自然科学基金(LY13F010001)
【分类号】：TN783
【正文快照】： 随着集成电路工艺的不断发展,芯片密度和时钟频率不断增加,导致低功耗设计的需求越来越急迫。特别是诸如便携式系统的电源需求和散热及环境问题等一些因素,使得低功耗的设计更有意义[1]。而超大规模集成电路中,占据系统总功耗30%~60%的时钟系统是最耗能模块之一。时钟系统是由

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