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锁相环频率合成器系统级设计研究

发布时间:2017-09-17 21:01

  本文关键词:锁相环频率合成器系统级设计研究


  更多相关文章: 锁相环频率合成器 电荷泵锁相环 MATLAB Simulink 锁相环噪声


【摘要】:频率合成器是电子通信系统中非常核心的模块之一,是时钟信号和本地震荡信号的重要产生方式。在当前的频率合成器实现形式中,锁相环频率合成器是主流的实现形式和研究重点,也是模拟电路系统中一个重要的研究方向。目前,主流的锁相环频率合成器系统架构是电荷泵锁相环,结构包含数字模块电路和模拟模块电路,是一个数模混合的负反馈系统。对于这样一个复杂的控制系统,系统级架构的确定是做好一个锁相环频率合成器的先决条件,系统级参数的设定和选取是实现频率合成器性能的关键所在。本文首先分析锁相环的信号传输理论,在理论研究和分析的基础之上研究锁相环的系统级建模,包括系统行为级建模和功能模块级建模,主要基于MATLAB和Simulink仿真工具。在此基础上,研究锁相环的噪声仿真、建模与优化。在系统宏观参数的研究基础上,探索锁相环具体模块电路的设计,以使其满足系统的需要和实现设计的最优化。在以上研究和分析的理论基础上,设计了一个400 MHz~450 MHz的电荷泵锁锁相环频率合成器。基于论文所述的系统级设计方法,首先根据锁相环系统指标,计算和规划出各模块具体指标和要求,基于180 nm CMOS RF工艺,在Cadence Spectre设计平台上完成锁相环电路的设计与仿真。然后,在原理图仿真设计完成后,利用Cadence Virtuoso平台上实现版图设计,在180 nm RF工艺上加工制作。芯片制作以及封装完成之后,设计PCB板级芯片测试电路,完成对芯片的测试。芯片参数如下,工作电压1.8 V,功耗15 mW,输出频率范围400 MHz~450 MHz,信道宽度15 MHz,带宽为200 KHz,锁定时间小于20μs,在1 MHz处相位噪声为-118 dBc/Hz@1 MHz,芯片面积为1620μm×1350μm。
【关键词】:锁相环频率合成器 电荷泵锁相环 MATLAB Simulink 锁相环噪声
【学位授予单位】:电子科技大学
【学位级别】:硕士
【学位授予年份】:2016
【分类号】:TN74
【目录】:
  • 摘要5-6
  • ABSTRACT6-9
  • 第一章 绪论9-14
  • 1.1 研究背景和意义9-11
  • 1.2 锁相环的历史和现状11-12
  • 1.3 锁相环研究的发展态势12
  • 1.4 本文研究的主要内容12-13
  • 1.5 本文章节安排13-14
  • 第二章 锁相环系统的原理概述14-33
  • 2.1 锁相环的基本认识和理解14-16
  • 2.2 锁相环系统线性模型16-19
  • 2.3 电荷泵锁相环及频率合成器19-22
  • 2.4 电荷泵锁相环系统传输函数22-31
  • 2.4.1 鉴频鉴相器和电荷泵22-25
  • 2.4.2 环路滤波器25-30
  • 2.4.3 压控振荡器30-31
  • 2.4.4 分频器31
  • 2.5 本章小结31-33
  • 第三章 锁相环的系统建模与仿真33-49
  • 3.1 锁相环频率合成器指标要求33-36
  • 3.1.1 工作频率范围33-34
  • 3.1.2 输出频率范围34
  • 3.1.3 频率分辨率34-35
  • 3.1.4 频谱纯度35
  • 3.1.5 锁定时间35-36
  • 3.2 锁相环的系统级设计流程36-40
  • 3.3 系统建模与仿真40-48
  • 3.3.1 系统行为级线性模型仿真40-43
  • 3.3.2 系统级模块化电路仿真43-46
  • 3.3.3 其他形式建模与仿真46-48
  • 3.4 本章小结48-49
  • 第四章 锁相环相位噪声的建模和仿真49-60
  • 4.1 相位噪声的含义49-51
  • 4.2 相位噪声的传输特性分析51-52
  • 4.3 各模块相位噪声的仿真52-58
  • 4.4 整体环路噪声的仿真58-59
  • 4.5 本章小结59-60
  • 第五章 电荷泵锁相环具体电路模块分析60-76
  • 5.1 鉴相鉴频器60-62
  • 5.2 电荷泵62-66
  • 5.3 低通滤波器66-67
  • 5.4 压控振荡器67-73
  • 5.5 分频器73-75
  • 5.6 本章小结75-76
  • 第六章 锁相环芯片设计与测试76-91
  • 6.1 锁相环电路设计76-86
  • 6.1.1 鉴相鉴频器电路78-79
  • 6.1.2 电荷泵电路79-80
  • 6.1.3 低通滤波器80
  • 6.1.4 压控振荡器电路80-82
  • 6.1.5 分频器电路82-84
  • 6.1.6 锁相环整体电路84-86
  • 6.2 锁相环芯片测试86-90
  • 6.2.1 PCB板制作86-88
  • 6.2.2 芯片测试结果88-90
  • 6.3 本章小结90-91
  • 第七章 总结91-92
  • 致谢92-93
  • 参考文献93-95
  • 攻读硕士学位期间取得的成果95-96

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