10GHz低相噪扩频时钟发生器的设计与实现

发布时间：2017-09-28 03:04

  本文关键词：10GHz低相噪扩频时钟发生器的设计与实现

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【摘要】：基于55nm CMOS工艺设计并制造了一款小数分频锁相环低相噪10GHz扩频时钟发生器(SSCG).该SSCG采用带有开关电容阵列的压控振荡器实现宽频和低增益,利用3阶MASHΔΣ调制技术对电路噪声整形降低带内噪声,使用三角波调制改变分频系数使扩频时钟达到5 000×10~(-6).测试结果表明:时钟发生器的中心工作频率为10GHz,扩频模式下峰值降落达到16.46dB;在1 MHz频偏处的相位噪声为-106.93dBc/Hz.芯片面积为0.7mm×0.7mm,采用1.2V的电源供电,核心电路功耗为17.4mW.
【作者单位】： 湖南大学物理与微电子科学学院;
【关键词】： 扩频时钟发生器 锁相环 ΔΣ调制器 相位噪声
【基金】：国家自然科学基金资助项目(61350007) 国家高技术研究发展计划(863计划)项目(2011AA010403)~~
【分类号】：TN432
【正文快照】： 当前,随着半导体工艺的不断发展,电子产品工作频率越来越高,高频信号的辐射也越来越强,芯片间的电磁干扰(EMI)变成了一个不容忽视的问题[1-2].在无线通信系统中,当数据处理与传输的速率达到Gbps的水平时,电路辐射产生的噪声大小直接决定了传输数据信号的优劣.为了抑制EMI对传

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本文编号：933417