基于Verilog的FIR数字滤波器设计与仿真

发布时间：2017-10-01 22:23

  本文关键词：基于Verilog的FIR数字滤波器设计与仿真

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【摘要】：设计一种基于Verilog的FIR数字低通滤波器。在结构上改变了以往乘法器和加法器的简单结合,利用分布式算法构造查找表进行乘累加运算,节约资源占用并且提高运算速率。利用Matlab工具设计和获取滤波器参数,并且进行仿真验证。滤波器参数量化后形成查找表,利用Verilog HDL语言对硬件电路模块进行设计描述,并且用Model Sim进行整个硬件电路系统的功能仿真,验证了设计的正确性。设计在速度和面积方面做了折中和优化,成功实现了数字滤波的功能。
【作者单位】： 北京工业大学电子信息与控制工程学院;
【关键词】： Verilog 数字滤波器 分布式算法 FIR
【基金】：国家自然科学基金(61204040;60976028) 教育部博士点基金(20121103120018) 北京市教育委员会科技计划面上项目(JC002999201301) 北京市自然科学基金资助(4152004)
【分类号】：TN713.7
【正文快照】： 从带有干扰的原始信号中提取有效信号并对其进行处理,几乎是所有科学技术领域都必然涉及的重要环节。信号处理的任务主要是对信号进行采样接收、频谱分析、域变换、综合和估值识别等[1]。现在的信号处理的系统主要分为两大类:模拟信号处理系统和数字信号处理系统。数字信号处

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8 陈s，

本文编号：956007