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基于FPGA和TDC芯片的高精度时间间隔计数器研制

发布时间:2021-07-06 16:54
  大型物理实验、国防和工业等应用场合对时间间隔测量精度需求通常达到百皮秒甚至十皮秒量级,并对多通道同步测量提出了新的要求。利用FPGA(field-programmable gate array)使用灵活的特性,研制了一种基于FPGA和TDC(time-to-digital conversion)芯片的高精度时间间隔计数器,使用Verilog硬件描述语言设计系统所需的配置模块、UART接口、SPI接口等完成测量。利用中国科学院国家授时中心钟房产生的10MHz标准频率信号作为参考时钟,1PPS时间信号作为测试信号,搭建平台对设计的时间间隔计数器进行测试评估。实验结果表明本计数器测量精度优于60ps,量程可达1.6s,可实现4通道同时测量,同时具备脉宽测量功能。该计数器采用模块化设计,可作为嵌入式设备使用。 

【文章来源】:时间频率学报. 2019,42(01)CSCD

【文章页数】:10 页

【部分图文】:

基于FPGA和TDC芯片的高精度时间间隔计数器研制


图1时间间隔测量的基本原理

测量原理,参考时钟


ΔT=TN+Ti1-Ti2。(1)当“开始”有信号到来时,系统开启参考时钟计数器,开始测量,参考时钟周期开始计数。“结束”信号到来时,停止计数。此时可以由公式(2)来计算“粗计数”时间间隔TN:TN=N×Tref。(2)“细测量”的测量原理如图2所示,本文介绍的“细测量”方法为抽头延迟线法。通过计算脉冲经过的延迟单元个数来进行时间间隔测量[13]。可以用公式(3)来计算,其中m为经过延迟单元个数,Δτ为每个延迟单元的延迟时间[14]。Ti=m×Δτ。(3)图2“细测量”测量原理1.2本系统测量原理系统测量的原理如图3所示,假设待测脉冲从通道1和2输入,假设通道1中信号先于通道2中信号到来,测量两通道输入信号之间的时间间隔[15]。图3系统测量原理本系统测量时,输出两个结果参数,可分别作为“粗”计数结果和“细”测量结果[16]。上电后即开始参考时钟数N的计数,并作为结果参数之一,即“粗”计数结果输出;当通道1中有待测脉冲到来时,先将此时的参考时钟数N1锁存,然后对参考时钟进行实时测量,得到测量值Tref1,同时测量该脉冲与它前一个参考时钟脉冲之间的时间间隔Δt1,将两者的比值锁存并作为另一个结果参数ti,即“细”测量结果输出,最后进行计算时,根据系统所配置参考时钟分频系数,按照公式(4)进行计算,式中LS

原理图,系统测量,原理,参考时钟


。此时可以由公式(2)来计算“粗计数”时间间隔TN:TN=N×Tref。(2)“细测量”的测量原理如图2所示,本文介绍的“细测量”方法为抽头延迟线法。通过计算脉冲经过的延迟单元个数来进行时间间隔测量[13]。可以用公式(3)来计算,其中m为经过延迟单元个数,Δτ为每个延迟单元的延迟时间[14]。Ti=m×Δτ。(3)图2“细测量”测量原理1.2本系统测量原理系统测量的原理如图3所示,假设待测脉冲从通道1和2输入,假设通道1中信号先于通道2中信号到来,测量两通道输入信号之间的时间间隔[15]。图3系统测量原理本系统测量时,输出两个结果参数,可分别作为“粗”计数结果和“细”测量结果[16]。上电后即开始参考时钟数N的计数,并作为结果参数之一,即“粗”计数结果输出;当通道1中有待测脉冲到来时,先将此时的参考时钟数N1锁存,然后对参考时钟进行实时测量,得到测量值Tref1,同时测量该脉冲与它前一个参考时钟脉冲之间的时间间隔Δt1,将两者的比值锁存并作为另一个结果参数ti,即“细”测量结果输出,最后进行计算时,根据系统所配置参考时钟分频系数,按照公式(4)进行计算,式中LSB为分频系数,测量前已设置好。根据公式(5)计算该脉冲到来的系统时刻Tsys1,其中T为参考脉冲周期[17]。通道2中另一个待测脉冲到来时利用同样的方

【参考文献】:
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[1]基于FPGA的精密时间间隔测量研究与实现[D]. 邹进波.西安科技大学 2011
[2]基于FPGA高分辨率短时间间隔测量的研究与实现[D]. 周增建.西安电子科技大学 2010
[3]一种基于TDC的时间间隔测量方法的研究[D]. 罗尊旺.西安电子科技大学 2009



本文编号:3268616

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