动态自适应低密度奇偶校验码译码器的FPGA实现

发布时间：2018-03-05 05:14

  本文选题：LDPC码译码器　切入点：动态自适应　出处：《电子与信息学报》2015年08期 　论文类型：期刊论文

【摘要】：在复杂深空通信环境中,自适应能力的强弱对低密度奇偶校验(LDPC)码译码器能否保持长期稳定工作具有重要影响。该文通过对DVB-S2标准LDPC码译码器各功能模块的IP化设计,将动态自适应理论参数化映射到各功能模块中,实现动态自适应LDPC码译码器的设计。基于Stratix IV系列FPGA的验证结果表明,动态自适应LDPC译码器可以满足不同码率码长及不同性能需求下的译码。同时,单译码通道可以保证译码数据信息吞吐率达到40.9~71.7 Mbps。
[Abstract]:In the complex and deep space communication environment, adaptive ability of low density parity check (LDPC) decoder can maintain long-term stability has an important influence. Through the design of IP DVB-S2 standard LDPC decoder of each functional module, the dynamic adaptive theory of parametric mapping to each function module, design and implementation dynamic adaptive LDPC decoder. Verification of Stratix IV series FPGA based on the results, the dynamic adaptive LDPC decoder can meet the decoding of different code length and different performance requirements. At the same time, single channel decoding can guarantee the decoding data rate of information throughput reached 40.9~71.7 Mbps.

【作者单位】： 中国科学院电子学研究所可编程芯片与系统研究室;中国科学院大学;
【基金】：国家自然科学基金(61404140,61271149,61106033)资助课题
【分类号】：TN911.22;TN791

【参考文献】

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【共引文献】

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【二级参考文献】

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