一种基于FPGA的超宽带雷达数字接收机

发布时间：2018-07-13 20:55

【摘要】：脉冲超宽带雷达回波信号由于带宽大而难以直接采样,文中设计并实现了一种基于FPGA的数字式脉冲超宽带雷达接收机。该接收机利用FPGA内嵌锁相环产生特定频率的时钟,驱动四路10 bit ADC器件,根据回波信号在一段时间内呈准静态及周期性的特点,实现了四通道时域伪随机等效采样。仿真及测试结果表明,该数字式脉冲超宽带雷达接收机等效采样速率可达10 GS/s,可有效接收雷达回波信号,满足脉冲超宽带雷达的应用需求。
[Abstract]:The echo signal of pulse UWB radar is difficult to be sampled directly because of its large bandwidth. A digital UWB radar receiver based on FPGA is designed and implemented in this paper. The receiver uses the phase-locked loop (PLL) in FPGA to generate a clock of a specific frequency and drives four channels of 10 bit ADCs. According to the quasi-static and periodic characteristics of the echo signal in a certain period of time, the four-channel pseudo-random equivalent sampling in time domain is realized. The simulation and test results show that the equivalent sampling rate of the digital UWB radar receiver can reach 10 GS / s, which can effectively receive the radar echo signal and meet the application requirements of the pulse UWB radar.
【作者单位】： 桂林电子科技大学信息与通信学院;
【基金】：广西自然科学基金资助项目(2013GXNSFFA019004,2013GXNSFFA019329) 广西无线宽带通信与信号处理重点实验室主任基金资助项目(12107)
【分类号】：TN958

【参考文献】

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【共引文献】

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【二级参考文献】

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本文编号：2120715