一种多优先级变长调度星载IP交换机交换结构的设计
[Abstract]:Aiming at the limited use of hardware resources in spaceborne IP switch, a large capacity shared storage switching structure with 8 priority, pointer replication and variable length packet scheduling mechanism is designed and implemented, and the specific composition of the circuit is given. Key scheduling algorithms and workflow. A complete 8 脳 8 switch structure is implemented by using Xilinx V4sx55FPGA. The circuit occupies 164K byte on-chip memory resources and 5982 input lookup tables, which can meet the design requirements of three-mode redundancy. When the main frequency of the system is 100 MHz, the off-chip SRAM is used and the data bit width is 64, the peak throughput of the switching structure can reach 1.6 Gbps.When the 133MHz DDR memory is used off-chip, the bit width is 64. The peak throughput of the switching structure can reach 4.25Gbps.After the multistage expansion of the switching unit, it can meet the system design requirements above 10Gbps.
【作者单位】: 解放军理工大学通信工程学院;
【分类号】:TN927.2;TN915.05
【参考文献】
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【共引文献】
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【二级参考文献】
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【相似文献】
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,本文编号:2175796
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