变采样周期锁相环的分析与设计

发布时间：2018-11-09 12:32

【摘要】：现有文献对变采样周期锁相环(variable sampling period PLL,VSP_PLL)的原理分析尚不深入,且未给出其调节器设计方法。通过与传统的基于同步旋转坐标系锁相环(synchronous reference frame PLL,SRF_PLL)对比,明晰了VSP_PLL的控制机制,揭示了其内在联系。建立了VSP_PLL的离散域数学模型,分析了采用不同调节器的VSP_PLL环路特性,得出了调节器(包括其型式及参数)的优化设计方法。实验结果验证了所设计的VSP_PLL在电网电压出现谐波、不平衡、幅值及频率瞬变的情况下均可准确快速地锁相。
[Abstract]:The principle of variable sampling period phase-locked loop (variable sampling period PLL,VSP_PLL) is not deeply analyzed in the literature, and the design method of its regulator is not given. Compared with the traditional phase-locked loop (synchronous reference frame PLL,SRF_PLL) based on synchronous rotating coordinate system, the control mechanism of VSP_PLL is clarified and its internal relationship is revealed. The discrete domain mathematical model of VSP_PLL is established, and the characteristics of VSP_PLL loop with different regulators are analyzed, and the optimal design method of regulator (including its type and parameters) is obtained. The experimental results show that the designed VSP_PLL can accurately and rapidly phase lock in the case of harmonic unbalance amplitude and frequency transients.
【作者单位】： 南京航空航天大学自动化学院;
【基金】：国家自然科学基金项目(51077070)~~
【分类号】：TN911.8

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本文编号：2320426