基于T264的编码器在多核异构处理器上的设计与实现

发布时间：2017-05-27 08:02

  本文关键词：基于T264的编码器在多核异构处理器上的设计与实现，由笔耕文化传播整理发布。

【摘要】：一直以来,在视频编码处理方案中,视频处理性能的提升或者限制都主要集中在硬件处理性能与视频处理算法两个方面。可以说,视频处理平台的性能与视频算法的算法处理能力决定了视频处理方案的优劣。在硬件平台方面,为了为视频处理方案提供一款高性能的处理平台,视频处理器的架构和性能都在不断的发展。近年来,TI公司更是提出了多核异构处理器TMS320DM8168,这款处理器可以代表目前世界上视频处理器的最高处理能力,同时随之提出的McFW多通路视频编码框架也是目前最复杂的编程框架。H.264是当今视频压缩标准中占据视频处理方案市场主流的压缩标准,同时也是最具研究开发意义的编码标准之一。本文选用H.264算法标准来完成视频处理方案中视频压缩的功能。结合DM8168硬件平台的结构特点,发挥各个子模块的特点,将系统划分为多个子系统进行模块化管理。把视频从采集到显示的各个过程分布到各个子系统,减小了单处理器的运算负载,大大提升了本系统的整体效率。同时,基于对多系统之间的协同工作、消息通信以及数据共享的机制进行研究设计,实现完整的工程链路。除此之外,本设计将视频处理算法优化包装到工程链路中,实现ARM+HDVPSS+DSP多核异构架构对视频的处理。并通过对比ARM单核处理器的视频性能验证本方案的性能优越性。
【关键词】：多核异构 HDVPSS处理器 H.264 DM8168
【学位授予单位】：西南交通大学
【学位级别】：硕士
【学位授予年份】：2015
【分类号】：TN919.81
【目录】：

• 摘要6-7
• Abstract7-10
• 第1章 绪论10-14
• 1.1 研究背景与意义10
• 1.2 国内外研究现状10-12
• 1.3 课题技术难点与研究路线12-13
• 1.4 课题主要工作及章节安排13-14
• 第2章 平台介绍14-26
• 2.1 硬件平台14-20
• 2.1.1 ARM子系统15
• 2.1.2 DSP处理器15-17
• 2.1.3 HDVPSS子系统17-19
• 2.1.4 集成外设19-20
• 2.2 软件平台20-25
• 2.2.1 软件层架构20-21
• 2.2.2 McFW编程框架与链路21-22
• 2.2.3 LINK机制与结构22-24
• 2.2.4 Frames结构与存储方式24-25
• 2.3 本章小结25-26
• 第3章 T264编码库研究26-29
• 3.1 T264视频编码标准关键技术26-27
• 3.2 T264编码器帧层编码流程解析27-28
• 3.3 本章小结28-29
• 第4章 方案的设计与规划29-37
• 4.1 任务规划29-30
• 4.2 多核间通信机制30-34
• 4.3 方案设计34-36
• 4.4 本章小结36-37
• 第5章 编码设计实现37-56
• 5.1 平台搭建37-39
• 5.1.1 硬件环境搭建37
• 5.1.2 软件环境搭建37-39
• 5.2 算法调试与优化39-50
• 5.2.1 T264编码算法调试与实现39-42
• 5.2.2 算法封装与Link的编译实现42-50
• 5.3 链路建立与调度实现50-54
• 5.3.1 Chains的实现50-52
• 5.3.2 链路调用函数实现52-54
• 5.4 存储接口的实现与数据存储的实现54-55
• 5.5 本章小结55-56
• 第6章 工程测试56-60
• 6.1 系统平台环境测试56-57
• 6.2 工程运行测试57-59
• 6.3 本章小结59-60
• 总结与展望60-62
• 致谢62-63
• 参考文献63-66
• 攻读硕士学位期间发表的论文与科研成果66

【参考文献】

中国期刊全文数据库 前7条

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中国硕士学位论文全文数据库 前4条

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本文编号：399265