一种新型宽频域全数字锁相环的研究与设计

发布时间：2017-06-15 20:04

  本文关键词：一种新型宽频域全数字锁相环的研究与设计，由笔耕文化传播整理发布。

【摘要】：锁相环电路是一个使输出信号与输入信号在频率和相位上保持同步的闭环控制系统。由于锁相环的性能优良,它已成为各类电子系统中不可缺少的基本部件。全数字锁相环相比模拟锁相环,具有一切数字电路特有的显著优点,即参数稳定,抗干扰能力强,集成度高。全数字锁相环还解决了模拟锁相环中压控振荡器(VCO)的非线性,鉴相器不精确,部件易饱和以及高阶环不稳定等难题。随着现场可编程逻辑门阵列的诞生以及锁相环理论与研究日益完善,全数字锁相环得到了越来越广泛的应用。本文在对国内外学者有关锁相环的研究成果进行深入分析与借鉴的基础上,针对传统全数字锁相环研究中存在的电路结构复杂、鉴相精度不高、锁相范围窄等问题,提出了一种新型全数字锁相环。与传统锁相环相比,在该锁相系统内,改进了鉴相模块的电路结构,其中的时间数字转换电路可将鉴相误差转换为高精度数字信号;采用基于PI控制的双边沿触发的数字环路滤波器取代了传统的数字环路滤波器的电路结构;采用可变模分频器来替换传统的固定模分频器。该全数字锁相环利用EDA技术进行系统设计,根据锁相环路系统中各个电路结构的要求,采用自顶向下的设计方法,用VHDL硬件描述语言进行综合设计,并用QuartusⅡ软件进行综合、编译和仿真分析,最后用FPGA芯片上予以验证与实现。在系统时钟为20MHz时仿真结果表明:该锁相环锁相范围约为100Hz-1MHz,系统频率捕获时间最快为2个左右输入信号周期,系统锁定时间最快为10个左右输入信号周期,且具有锁相范围大、电路结构简单和易于集成等特点。
【关键词】：可编程逻辑门阵列 全数字锁相环 时间数字转换电路 比例积分控制 双边沿触发数字环路滤波器
【学位授予单位】：南华大学
【学位级别】：硕士
【学位授予年份】：2015
【分类号】：TN911.8
【目录】：

• 摘要4-6
• Abstract6-11
• 第1章 绪论11-17
• 1.1 锁相环研究背景及发展11-12
• 1.2 全数字锁相环的国内外研究现状12-14
• 1.3 本文的主要研究内容与结构的安排14-17
• 第2章 锁相环的组成及理论17-31
• 2.1 锁相环的工作原理17-18
• 2.2 锁相环的基本结构18-24
• 2.2.1 鉴相器（PD）模块18-21
• 2.2.2 环路滤波器(LPF)模块21-22
• 2.2.3 压控振荡器(VCO)模块22-24
• 2.3 锁相环的捕获、跟踪特性及主要性能参数24-26
• 2.3.1 锁相环的捕获及跟踪特性24
• 2.3.2 锁相环的主要性能指标24-26
• 2.4 基于比例积分控制算法的模拟锁相环的性能分析26-29
• 2.5 本章小结29-31
• 第3章 数字锁相环的组成及工作原理31-47
• 3.1 数字锁相环的基本结构及原理31-32
• 3.2 数字鉴相器的基本结构及原理32-37
• 3.3 数字滤波器的基本结构及原理37-40
• 3.4 数控振荡器的基本结构及原理40-42
• 3.5 基于PI控制算法的全数字锁相环的系统性能分析42-45
• 3.5.1 全数字锁相环的数学模型分析42-44
• 3.5.2 全数字锁相环的稳定性分析44
• 3.5.3 全数字锁相环的动态性能分析44-45
• 3.6 本章小结45-47
• 第4章 新型宽频域全数字锁相环的研究及设计47-67
• 4.1 新型宽频域全数字锁相环结构框图47-48
• 4.2 数字鉴相器（DPD）模块48-55
• 4.2.1 检测模块的设计48-50
• 4.2.2 相位误差量化电路的原理与设计50-55
• 4.3 双边沿触发的数字环路滤波器55-58
• 4.4 数控振荡器模块58-60
• 4.5 测频模块60-61
• 4.6 新型宽频域全数字锁相环的仿真分析及硬件电路实现61-65
• 4.7 本章小结65-67
• 第5章 总结与展望67-69
• 5.1 研究工作总结67-68
• 5.2 前景展望68-69
• 参考文献69-73
• 发表论文及科研情况说明73-74
• 致谢74

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