基于FPGA的循环冗余校验码设计

发布时间：2017-10-09 04:00

本文关键词：基于FPGA的循环冗余校验码设计

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【摘要】：本文主要介绍了循环冗余校验码的模块设计及其基本原理,并利用Verilog HDL设计循环冗余校验码,给出了基于FPGA的可编程逻辑器件的实现方法及其仿真结果.同时阐述了循环冗余校验码的应用前景。
【作者单位】：成都理工大学信息科学与技术学院;
【关键词】： 循环冗余校验码 Verilog FPGA
【分类号】：TN911.2
【正文快照】： ·154·成都理工大学信息科学与技术学院周亮余小平在现代数字通信中,要求信息在传输过程中所造成的数字差错必须足够低。但由于通信信道里存在的噪声和通信信道不理想的传输特性造成了信号的码间串扰,从而导致了信息在传输过程产生了差错。所以为了最大限度的保证通信过程中

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