基于环形压控振荡器的电荷泵锁相环设计

发布时间：2017-11-06 05:36

  本文关键词：基于环形压控振荡器的电荷泵锁相环设计

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【摘要】：在阐述了电荷泵锁相环的工作原理、分析和设计方法的基础上,结合环路稳定性和相位噪声两方面因素对锁相环电路进行了建模及分析。介绍了锁相环的系统级参数设计到电路设计的完整流程。首先利用Verilog-A语言建立了一个考虑各电路模块主要非理想因素的较为精确的锁相环行为级模型,然后进行单元电路的设计,考虑了温度变化对环形压控振荡器和锁相环系统的影响并分别进行了温度补偿。采用Cadence公司的Spectre-RF系列软件进行仿真,最后得到的锁相环输出频率范围为150 MHz~350 MHz,相位噪声为-113.8 dBc/Hz(振荡频率为240 MHz,频偏为2 MHz时),均方根抖动为3.65 ps,锁定时间小于3μs,可为高速数字电路产生低抖动的片上时钟信号。
【作者单位】： 杭州电子科技大学电子信息学院;
【分类号】：TN911.8
【正文快照】： 0 引言 锁相环(Phase Lock Loop,PLL)具有数据时钟恢复、消除时钟抖动、频率合成等多种用途。自从1965年PLL集成电路问世以来,PLL设计技术越来越成熟,从分立器件到集成电路,从双极型工艺到CMOS技术[1]。当前PLL的研究热点主要集中在低相位噪声、低杂散、高集成度、低电压、低

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