基于FPGA的CRC查表法设计及优化

发布时间：2018-01-06 00:16

  本文关键词：基于FPGA的CRC查表法设计及优化　出处：《电测与仪表》2017年03期 　论文类型：期刊论文

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【摘要】：循环冗余校验Cyclic Redundancy Checks(CRC)具有检错能力极强,开销小,易于用编码器及检测电路实现,远远优于奇偶校验及算术和校验等方式的特点,故在串行通信中添加CRC校验可保证通信的有效性。而FPGA具有灵活稳定,快速高效的特点,故用VHDL实现CRC查表法设计并对其优化分析,使其在串行通信中具有良好的稳定性,提高数据传输的准确性。
[Abstract]:Cyclic redundancy check Cyclic Redundancy Checks ( CRC ) has the characteristics of extremely strong error detection ability , small overhead , easy realization with encoder and detection circuit , which is much better than parity check and arithmetic and check .

【作者单位】： 中北大学电子测试技术国家重点实验室;中北大学仪器科学与动态测试教育部重点实验室;
【分类号】：TN791;TN911.22
【正文快照】： 0引言在数据存储和数据通信网络等领域中,由于传输的不确定性及干扰等情况,使得通信出现异常,因此在串行通信中添加校验是必不可少的[1]。而FP-GA来做数字信号处理是完全的硬件化、并行化编程操作,具有灵活调节的优点[2],故广泛应用于串行通信中。在通信中,常规的CRC校验是按

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本文编号：1385477