相干光通信系统中DPSK解调技术的研究
【图文】:
信号处理模块采用TSW1400EVM信号处理板,如图3-2所示。其核心芯片为ALTREA公司Stratix IV系列EP4SGX70HFC3芯片,该芯片具有680K逻辑单元(Logic Element,LE)、22.4Mbits嵌入式存储器以及1360个18× 18乘法器;具有两个速度等级,同时具备先进的逻辑和布线体系结构;具有48个高速收发器和1067Mbps存储器接口;采用40nm工艺技术,实现低功耗;支持即插即用并保证信号完整性。图3-2 TSW1400EVM信号处理板Fig.3-2 TSW1400EVM Signal Processing Board
时钟模块,如图3-6所示。该模块采用时钟调节器件LMK04806,,具有优异的时钟抖动消除、时钟发生和时钟分配功能,并且与低噪声VCOX参考源结合使用时,采用双环路PLL结构可以实现输出时钟信号非常低的抖动。双环路结构有由两个高性能锁相环组成,第一个PLL(PLL1)具有低噪声抖动消除功能,第二个PLL(PLL2)执行时钟的生成。PLL1可配置为与外部VCXO模块配合使用,产生更低抖动的参考时钟,当环路带宽很窄时,PLL1通过VCXO或可调晶体清理输入时钟,同时PLL1的输出被用作PLL2的输入时钟,并通过PLL1锁定VCXO的输出。PLL1的输出用作集成VCO的PLL2的参考时钟。PLL2的环路带宽可以被优化以清除远端相位噪声(高于50kHz的偏移)
【学位授予单位】:西安理工大学
【学位级别】:硕士
【学位授予年份】:2019
【分类号】:TN929.1
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本文编号:2613303
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