基于FBMC的同步算法研究与实现
本文关键词:基于FBMC的同步算法研究与实现,由笔耕文化传播整理发布。
【摘要】:近几年里,为了满足日益增长的巨大需求,第五代移动通信系统(5G,也称IMT-2020)正在如火如荼的研究当中。正交频分复用技术(Orthogonal Frequency Division Multiplexing,OFDM)对第五代移动通信系统的一些新要求显得无能为力,而滤波器组多载波技术(Filter Bank Based Multi Carrier,FBMC)作为其改进技术之一正在被众多学者所研究。同步技术是FBMC系统的关键技术之一,但是目前对基于FBMC的同步算法研究非常少,少数的研究文献也只是涉及算法部分,对于同步的整体流程及硬件实现的研究更少。本文主要研究了FBMC调制系统的同步算法,首先对非常成熟的基于OFDM的同步算法进行研究,提出了AHC改进算法,并分析了其应用于FBMC系统的可行性。然后对目前已有的FBMC同步算法进行了仿真及性能对比分析,提出了一种与自适应递归小数倍频偏估计算法相联合的整数倍频偏估计算法,并给出了一种在多径衰落信道下的同步算法方案。最后在综合考虑了同步算法性能和硬件实现复杂度的情况下,给出了同步的硬件实现方案设计,并进行了FPGA实现。首先,本文简述了移动通信的发展史及5G的一些关键技术方向,分析了面对5G提出的新的挑战,FBMC技术相对于OFDM技术的优势,继而分析了针对FBMC的同步技术的研究意义和研究现状,并详细介绍了FBMC技术及其快速实现算法和与同步相关的一些基本原理。然后,基于多径衰落信道模型,本文研究了针对FBMC技术的同步算法。首先研究了基于OFDM的同步算法应用于FBMC系统的可行性。综合考虑之下,结论表明只有研究基于FBMC符号结构的同步算法才能解决问题,本文首先在多径衰落信道下对定时同步算法进行了性能仿真和分析,然后分析了如何取得小数倍频偏估计误差与估计范围的平衡,采用了一种自适应递归的方法,并且提出了与之相联合的整数倍频偏估计算法,可以对合理范围内的任意频偏进行比较准确的估计。最后给出了一种在多径衰落信道模型下的性能较优的同步方案,并验证了其正确性。最后,本文在综合考虑了算法的性能和硬件实现复杂度等因素的前提下,给出了同步算法的硬件实现方案设计,并完成了同步模块的功能验证。在综合后资源消耗合理且无时序错误的情况下,下板验证了硬件设计的正确性。
【关键词】:FBMC OFDM 定时同步 频偏估计 FPGA
【学位授予单位】:电子科技大学
【学位级别】:硕士
【学位授予年份】:2016
【分类号】:TN929.5
【目录】:
- 摘要5-6
- ABSTRACT6-13
- 缩略词表13-14
- 第一章 绪论14-20
- 1.1 论文的研究背景及意义14-16
- 1.1.1 移动通信系统发展历程14-15
- 1.1.2 FBMC系统同步技术的研究意义15-16
- 1.2 基于FBMC的同步技术的研究现状16-18
- 1.3 论文的主要工作和内容安排18-20
- 第二章 FBMC基础研究及信道介绍20-33
- 2.1 多载波技术理论及ZC序列介绍20-25
- 2.1.1 OFDM技术20-21
- 2.1.2 广义多载波技术21
- 2.1.3 时频局部化多载波系统21-24
- 2.1.4 Zadoff-Chu序列特性24-25
- 2.2 FBMC系统的快速实现算法25-30
- 2.2.1 发送端调制快速实现算法25-28
- 2.2.2 接收端解调快速实现算法28-30
- 2.3 无线信道模型30-31
- 2.4 FBMC调制解调正确性验证31-32
- 2.5 本章小结32-33
- 第三章 FBMC系统同步算法研究33-67
- 3.1 时频同步偏差的影响33-37
- 3.1.1 时频分析中的互模糊函数33-34
- 3.1.2 定时同步偏差的影响34-35
- 3.1.3 载波频率偏差的影响35-37
- 3.2 OFDM同步算法应用于FBMC系统37-49
- 3.2.1 基于ZC序列的定时同步算法37-40
- 3.2.2 重复冗余定时同步算法40-45
- 3.2.3 频偏估计算法45
- 3.2.4 同步算法性能仿真及可行性分析45-49
- 3.3 FBMC符号同步算法仿真及性能分析49-66
- 3.3.1 同步训练符号结构50-51
- 3.3.2 基于FBMC符号结构的同步算法51-58
- 3.3.3 频偏估计算法58-63
- 3.3.4 同步算法仿真及性能分析63-65
- 3.3.5 FBMC同步方案及分析65-66
- 3.4 本章小结66-67
- 第四章 FBMC系统同步的FPGA实现67-81
- 4.1 同步硬件实现整体方案67-68
- 4.2 同步主要模块的硬件实现架构设计68-74
- 4.2.1 定时同步模块68-70
- 4.2.2 自适应递归小数倍频偏估计模块70-71
- 4.2.3 小数倍频偏补偿模块71
- 4.2.4 FBMC解调模块71-73
- 4.2.5 整数倍频偏估计和补偿模块73-74
- 4.3 同步算法的FPGA实现74-77
- 4.3.1 硬件测试平台74
- 4.3.2 定时同步模块74-75
- 4.3.3 自适应递归小数倍频偏估计模块75-76
- 4.3.4 频偏补偿模块76
- 4.3.5 FBMC解调模块76-77
- 4.4 同步算法的功能验证77-80
- 4.5 同步算法的板级验证80
- 4.6 本章小结80-81
- 第五章 总结与展望81-83
- 致谢83-84
- 参考文献84-87
- 个人简历及攻硕期间取得的研究成果87-88
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,本文编号:469368
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