信道编译码算法研究与实现

发布时间：2017-08-21 04:32

  本文关键词：信道编译码算法研究与实现

  更多相关文章： VLC RS码 卷积码

【摘要】：通信系统的信号在传播过程中,会受到乘性和加性噪声的干扰而发生形变,使得接收机的检测出现错误。在发送端对信号进行编码以增加冗余度,在接收端则采用译码方法进行信号接收的方法可以有效降低信号接收的误码率,保证系统信号传输的可靠性。本文对RS码的编译码方法、卷积码的编译码方法、RS码和卷积码的级联进行了研究与实现,主要工作如下：一、提出了一种RS码的改进译码算法。在介绍RS码编码原理与译码算法的基础上,对现有Chase 2译码方法进行了改进,减少了原有算法中试探序列集合中元素数目；仿真表明,改进后的算法在性能稍有损失的基础上极大降低了计算复杂度。此外,论文还对RS码在加性高斯白噪声信道、实际测量的可见光通信(VLC)信道下,仿真了在不同冗余度条件下的误码率性能。二、分别在理想高斯白噪声信道以及实测VLC信道条件下,仿真了卷积码编码约束长度和译码回溯深度这两个参数的不同取值对误码率性能的影响,此外在理想信道下仿真了Turbo码在不同译码算法和不同迭代次数时的误码率性能,并与卷积码的性能进行了仿真对比。三、仿真分析了可见光信道下RS码与卷积码级联编码的误码率性能。在加性高斯白噪声信道下对RS码和卷积码级联编码系统,仿真了在RS码的不同最大纠错符号数、卷积码不同约束长度下的系统误码率性能。四、对RS码、卷积码以及它们的串行级联编码,编写了Verilog HDL代码,并完成了硬件实现。论文描述了物理实现的平台与流程,分析了各模块的时序与资源消耗,给出了硬件实现方案。
【关键词】：VLC RS码 卷积码
【学位授予单位】：东南大学
【学位级别】：硕士
【学位授予年份】：2016
【分类号】：TN911.22
【目录】：

• 摘要5-6
• Abstract6-13
• 第1章 绪论13-17
• 1.1 研究背景13-14
• 1.2 国内外研究现状14-15
• 1.3 论文研究内容及意义15-16
• 1.4 论文组织结构16-17
• 第2章 RS码译码算法改进17-33
• 2.1 引言17-19
• 2.2 发送端RS码编码19-21
• 2.3 接收端RS码译码21-29
• 2.3.1 RS伴随式译码算法21-27
• 2.3.2 RS软判决译码算法27-29
• 2.4 改进的RS译码算法29-31
• 2.5 本章小结31-33
• 第3章 卷积码译码性能仿真33-49
• 3.1 引言33-35
• 3.2 卷积码系统模型35-40
• 3.2.1 发送端卷积编码35-37
• 3.2.2 接收端卷积译码37-40
• 3.3 卷积码性能仿真分析40-43
• 3.4 Turbo码系统模型43-47
• 3.4.1 Turbo码编码译码模型43-44
• 3.4.2 Turbo码性能仿真44-47
• 3.5 本章小结47-49
• 第4章 信道级联编码性能分析49-57
• 4.1 引言49
• 4.2 串行级联与交织49-52
• 4.3 串行级联编码性能仿真52-56
• 4.4 小结56-57
• 第5章 信道编码的实现57-71
• 5.1 引言57
• 5.2 FPGA开发平台搭建及设计流程57-59
• 5.3 信道编码译码模块实现59-68
• 5.3.1 RS码实现59-64
• 5.3.2 卷积码实现64-68
• 5.4 级联实现68-69
• 5.5 本章小结69-71
• 第6章 总结与展望71-73
• 参考文献73-77
• 致谢77-79
• 作者简介79

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本文编号：710863