基于FPGA内嵌DSP硬核的脉冲压缩设计与实现

发布时间：2017-09-17 02:33

  本文关键词：基于FPGA内嵌DSP硬核的脉冲压缩设计与实现

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【摘要】：在伪随机编码体制的超宽带雷达中,原始回波信号的实时脉冲压缩是信号处理的首要和关键步骤。由于超宽带雷达的采样率高、数据量大,而微处理器处理速度和DSP芯片运算能力有限,提出了一种基于FPGA内嵌DSP硬核的快速实时脉冲压缩方法。基于时间域的互相关算法,通过调用FPGA中的DSP硬核进行并行计算,并结合流水线模式,实现快速实时脉冲压缩。仿真与实验结果表明,本文的方法能很好地实现超宽带雷达原始回波信号的快速实时脉冲压缩。
【作者单位】： 中国科学院电磁辐射与探测技术重点实验室;中国科学院大学;
【关键词】： 脉冲压缩 FPGA 并行计算 流水线 时间域
【分类号】：TN957.51
【正文快照】： 1引言超宽带雷达具有穿透能力强和距离向分辨率高等优点[1],它广泛应用于地质勘测、生命救援、穿墙目标识别与跟踪、反恐维稳、城市巷战等多种军用与民用领域[2-4]。传统的超宽带雷达是脉冲体制的超宽带雷达[5],但其探测距离有限、抗干扰能力差。由于伪随机编码信号的自相关特

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