基于IEEE-1588的高精度时钟同步系统设计

发布时间：2017-10-09 20:46

  本文关键词：基于IEEE-1588的高精度时钟同步系统设计

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【摘要】：为提高高速铁路地震预警系统采集设备时间同步精度,设计了基于IEEE-1588的网络高精度时钟同步系统。系统利用STM32+FPGA构架搭建硬件平台,在FPGA中利用PLL延迟测量法实现高精度时间间隔测量,时间间隔测量精度达到600 ps;利用PHY芯片DP83640获取网络PPS时钟,在STM32中结合卡尔曼滤波与PID算法,实现网络PPS时钟对本地时钟的校正,以及对本地PPS相位校正,最终完成同步系统的软件设计。测试结果表明:本设计时钟同步误差优于3 ns,且具备长期稳定性。
【作者单位】： 三峡大学电气与新能源学院;国网黄冈供电公司;
【关键词】： 时钟同步 IEEE- PLL延迟测量法 分布式数据采集
【基金】：三峡大学2015年硕士学位论文培优基金项目(2015PY039)
【分类号】：U298;TH714
【正文快照】： 高速铁路地震预警系统在铁路沿线及地震带附近设置大量地震数据采集装置,通过实时采集数据,在地震发生初期对铁路将受到的破坏进行快速估计和反应,在铁路受到地震破坏前减速或停车以降低损失[1]。所以,系统内各地震数据采集设备及中央处理单元间的时钟同步精度是预警成功与否

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3 马v浽，

本文编号：1002344