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时分复用数字闭环电容式微加速度计接口电路

发布时间:2017-12-05 09:10

  本文关键词:时分复用数字闭环电容式微加速度计接口电路


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【摘要】:为实现电容式微加速度计的数字输出闭环,设计了一种数字输出闭环ASIC(Application Specific Integrated Circuit)接口电路,以降低电路输出噪声并提高测量量程。对已有的电容式微加速度计ASIC电路进行了改进,分时段在中间极板上加载差分电容读出信号和由脉宽调变(PWM)波控制的反馈信号,然后由控制器实现闭环,利用Sigma Delta调制器实现模数转换。通过分析差分电容读出电路和Sigma Delta调制器的原理和特性,建立了该数字输出闭环电容式微加速度计的模型,进行了系统的设计与仿真。实验结果表明,该数字输出闭环电容式微加速度计的噪声水平为9.6μg/√Hz,量程为±3g。这些结果验证了时分复用方案的可行性和本文所提出模型的正确性。
【作者单位】: 清华大学精密仪器系精密测试技术及仪器国家重点实验室;清华大学微电子学研究所;
【基金】:十二五预研资助项目(No.20114113015)
【分类号】:TH824.4
【正文快照】: 1引言微加速度计是一种利用微机械加工工艺制造的惯性传感器,因具备体积小、噪声低、精度高等优点被广泛应用于惯性导航、汽车安全、智能手机等领域[1]。电容式闭环微加速度计通过检测敏感质量块的位移变化趋势并施加静电反馈力,保持动极板在平衡位置,其施加的静电力可反映输

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1 刘晓e,

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