高速信号采集处理电路时钟网络分析与设计

发布时间：2018-01-11 08:08

  本文关键词：高速信号采集处理电路时钟网络分析与设计　出处：《空间电子技术》2016年06期 　论文类型：期刊论文

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【摘要】：时钟网络可实现时钟产生、恢复、抖动滤除,频率合成和转换、分发和驱动等功能。时钟网络在高速信号采集处理电路中起着至关重要的作用。该部分设计的好坏直接影响产品的性能,甚至功能能否实现。首先将时钟芯片按照功能进行了区分,分析了几种时钟接口匹配方式,然后设计了一种时钟网络,经过仿真和测试,电路各项指标均满足设计要求,证明时钟分配网络性能优异。借鉴该方法,选择合适的芯片,能满足目前多数高速信号采集处理电路的设计需求。
[Abstract]:Clock network can achieve clock generation, recovery, jitter filtering, frequency synthesis and conversion. The clock network plays an important role in the high-speed signal acquisition and processing circuit. The design of this part directly affects the performance of the product. Even whether the function can be realized. Firstly, the clock chip is distinguished according to its function, several clock interface matching methods are analyzed, and then a clock network is designed, which is simulated and tested. All the parameters of the circuit meet the design requirements and prove that the performance of the clock distribution network is excellent. By using this method and selecting the appropriate chip, the design requirements of most high speed signal acquisition and processing circuits can be met.
【作者单位】： 中国空间技术研究院西安分院;
【分类号】：TN711.1
【正文快照】： 0引言随着处理芯片(DSP、FPGA)能力的快速提升,模数转换芯片(AD、DA、DDS)采样频率的迅速提高,高速信号采集处理电路的能力变得越来越强大。在雷达、通信、导航等各个领域获得了越来越迅猛的发展和应用,这同时也对电路设计提出了更高的要求[1-5]。高速电路的各类芯片都必须在

【参考文献】

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【二级参考文献】

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本文编号：1408740