一种伪差分两级环形振荡器的设计

发布时间：2018-01-29 01:59

  本文关键词： 环形振荡器 伪差分两级环形振荡 相位噪声　出处：《微电子学》2017年05期 　论文类型：期刊论文

【摘要】：设计了一种伪差分两级环形振荡器,可为锁相环提供8GHz四相位正交时钟。通过分析耦合两级环形振荡线性模型,对四级环形振荡结构进行优化,提出了伪差分两级环形振荡结构。基于单级缓冲器的开环分析,可对振荡器的输出频率进行精准估算,并判断振荡情况。采用65nm CMOS工艺进行设计与仿真。结果表明,在1.2V电压下,振荡器的功耗为6.9mW,1 MHz频率处的相位噪声为-82.104 5dB,满足高速SerDes接口的设计要求。
[Abstract]:A pseudo-differential two-stage ring oscillator is designed, which can provide an 8GHz four-phase quadrature clock for the phase-locked loop. By analyzing the coupled two-stage ring oscillation linear model, the four-stage ring oscillation structure is optimized. Based on the open-loop analysis of single-stage buffer, the output frequency of the oscillator can be accurately estimated. The results show that the power consumption of the oscillator is 6.9 MW at 1.2V voltage. 1 the phase noise at MHz frequency is -82.1045 dB, which meets the design requirements of high-speed SerDes interface.
【作者单位】： 国防科学技术大学计算机学院;
【基金】：国家自然科学基金资助项目(61133007,61402505)
【分类号】：TN752
【正文快照】： 0引言压控振荡器是时钟恢复电路中锁相环的核心电路。与LC振荡器相比,RC环形振荡器具有频率调节范围大、芯片面积小的特点,并且随着工艺的不断进步,基于CMOS反相器结构的环形振荡器在性能上具有较大的提升空间[1]。振荡器作为一个非线性的反馈系统,要产生稳定的振荡,需满足两

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本文编号：1472187