基于FPGA的虚拟FIFO改进设计

发布时间：2018-03-07 03:37

  本文选题：现场可编程门阵列　切入点：双倍速率　出处：《沈阳工业大学学报》2016年03期 　论文类型：期刊论文

【摘要】：为了降低网络接口缓存设计的开发难度和复杂度,对现有基于FPGA的DDR2虚拟FIFO设计进行了改进.提出了以FPGA(EP4CGX150F672)为核心、DDR2(MT47H128M16RT-25E)为数据缓存、采用Qsys系统互联及IPCORE辅助搭建设计的改进方案,实现了DVB-IP分组TS流的快速缓存,平滑IP网络抖动,避免了数据码流丢失和延迟过大的问题.该设计方案在降低传统设计难度和复杂度的背景下,具有良好的存储器兼容性,同时具有系统资源丰富、容量大、成本低和开发周期短等优点,在众多DVB行业的设备中使用后效果良好.
[Abstract]:In order to reduce the development difficulty and complexity of network interface cache design, the existing DDR2 virtual FIFO design based on FPGA is improved. An improved scheme is proposed, which takes FPGA EP4CGX150F672 as the core data cache, Qsys system interconnection and IPCORE aided design. The fast buffer of DVB-IP packet TS stream is realized, the jitter of IP network is smoothed, and the problems of data stream loss and delay are avoided. Under the background of reducing the difficulty and complexity of traditional design, the design scheme has good memory compatibility. At the same time, it has the advantages of rich system resources, large capacity, low cost and short development cycle.
【作者单位】： 成都工业学院通信工程学院;成都盟升科技有限公司遥感事业部;
【基金】：四川省教育厅基金资助项目(14ZA0288)
【分类号】：TN791

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本文编号：1577804