高性能LDPC编码器IP核设计与验证
本文选题:LDPC 切入点:动态配置 出处:《微电子学与计算机》2017年04期
【摘要】:为了实现大数据时代以固态硬盘为代表的大容量高吞吐率存储器的纠错编码,基于数学特性优异的LDPC码,提出了一种半并行的LDPC编码器架构.采用SIMD指令的调度控制流方式实现了RU编码算法,完成了码率和码长等参数可动态配置的LDPC编码器的电路设计.通过Matlab与ModelSim联合仿真,并在Xilinx FPGA平台上验证了编码器的功能正确性.结果表明:工作频率为100 MHz时,配置时间少于7μs且相对于其它编码器结构可以在较少的资源下吞吐率可达4.82Gb/s.
[Abstract]:In order to error correction encoding high throughput memory capacity to achieve big data era with SSD as the representative, based on the mathematical characteristics of excellent LDPC code, this paper proposes a kind of semi parallel LDPC encoder architecture. Flow using SIMD commands to control the realization of the RU encoding algorithm, finished the circuit design parameters of rate and length can LDPC encoder dynamic configuration. Through the joint simulation of Matlab and ModelSim, and verify the functional correctness of Xilinx encoder in FPGA platform. The results show that the working frequency is 100 MHz, the configuration time of less than 7 Mu s and relative to the can in less resources under the throughput of other 4.82Gb/s. encoder structure
【作者单位】: 清华大学微电子学研究所;全球能源互联网研究院信息与通信研究所;
【基金】:国家电网公司科技项目(SGRIDGKJ[2013]209号)
【分类号】:TN762
【参考文献】
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【共引文献】
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,本文编号:1703117
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