基于BLF时钟的RFID低功耗数字基带设计

发布时间：2018-04-19 23:44

  本文选题：射频识别(RFID)标签 + 数字基带　； 参考：《半导体技术》2017年04期

【摘要】：提出了一种符合ISO/IEC 18000-6C协议中关于时序规定的射频识别(RFID)无源标签芯片低功耗数字基带处理器的设计。基于采用模拟前端反向散射链路频率(BLF)时钟的方案,将BLF的二倍频设置为基带中的全局时钟,构建BLF和基带数据处理速率之间的联系;同时在设计中采用门控时钟和行波计数器代替传统计数器等低功耗策略。芯片经TSMC 0.18μm CMOS混合信号工艺流片,实测结果表明,采用该设计的标签最远识别距离为7 m,数字基带动态功耗明显降低,且更加符合RFID协议的要求。
[Abstract]:A low power digital baseband processor for radio frequency identification (RFID) passive tag chip in accordance with ISO/IEC 18000-6C protocol is proposed. Based on the scheme of analog front-end backscatter link frequency (BLF) clock, the double frequency of BLF is set as the global clock in baseband, and the relation between BLF and baseband data processing rate is constructed. At the same time, the gating clock and traveling wave counter are used to replace the traditional counter in the design. The chip is processed by TSMC 0.18 渭 m CMOS mixed signal technology. The measured results show that the maximum recognition distance of the label is 7 m, and the dynamic power consumption of digital baseband is obviously reduced, which is more in line with the requirements of RFID protocol.
【作者单位】： 西藏民族大学信息工程学院;西藏光信息处理与可视化技术重点实验室;西安电子科技大学微电子学院宽禁带半导体材料与器件重点实验室;
【基金】：西藏高校青年教师创新支持计划资助项目(QC2015-60)
【分类号】：TP391.44;TN402

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本文编号：1775302