基于FPGA的可消除高频非线性的动态分频鉴相器

发布时间：2018-04-27 07:36

  本文选题：高速比较器 + FPGA　； 参考：《电子技术应用》2017年12期

【摘要】：提出了一种可消除高频非线性的动态分频鉴相器的结构和实现方法,输入信号经波形变换后,利用FPGA进行分频,并通过8位拨码开关来设置1~255不同的分频系数,分频后通过数字鉴相器、低通滤波器和调理放大电路实现鉴相。这种设计不仅大大提高了鉴相范围和灵敏度,而且消除了高频非线性化现象。实验表明,该数字鉴相器输入频率范围200 kHz~100 MHz,鉴相范围-510π~+510π,线性度优于±1.5%,同时具有根据不同应用需求进行动态分频的特点。
[Abstract]:In this paper, the structure and implementation method of a dynamic phase divider which can eliminate the high frequency nonlinearity is proposed. After waveform transformation, the input signal is divided by using FPGA, and the frequency division coefficients of 1 / 255 are set by the 8 bit dial code switch. After frequency division, phase discrimination is realized by digital phase detector, low pass filter and conditioning amplifier circuit. This design not only improves the range and sensitivity of phase detection, but also eliminates the phenomenon of high frequency nonlinearity. The experimental results show that the input frequency range of the digital phase detector is 200 kHz~100 MHzand the phase detection range is -510 蟺 ~ 510 蟺, the linearity is better than 卤1.5, and it has the characteristics of dynamic frequency division according to different application requirements.
【作者单位】： 北京信息科技大学光电测试技术北京市重点实验室;国防科学技术大学电子科学与工程学院;
【基金】：国家级大学生创新创业训练计划支持项目(201711232011)
【分类号】：TN763.3

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本文编号：1809844