一种高速高精度动态比较器

发布时间：2018-05-21 04:10

  本文选题：逐次逼近模数转换器 + 预放大锁存比较器　； 参考：《微电子学》2017年02期

【摘要】：提出了一种应用于逐次逼近模数转换器的高速高精度比较器。该比较器由2级预放大器、1级锁存比较器以及缓冲电路构成。在前置预放大器中采用共源共栅结构、复位和箝位技术,提高了比较器的精度和速度,降低了功耗。在锁存比较器中引入额外的正反馈路径,提高了响应速度,降低了功耗。将锁存比较器输入对管与锁存结构隔离,降低了踢回噪声的影响,提高了比较器的精度。比较器基于SMIC 0.18μm CMOS工艺进行设计与仿真。仿真结果表明,在1.8V电源电压、800MHz时钟下,比较器的精度为50μV,传输延迟为458ps,功耗为432μW,芯片面积仅为0.009mm~2。
[Abstract]:A high-speed and high-precision comparator is proposed for successive approximation A / D converters. The comparator consists of a 2-stage preamplifier and a 1-stage latch comparator and a buffer circuit. In the preamplifier, the common-gate structure, reset and clamping technology are used to improve the accuracy and speed of the comparator and reduce the power consumption. An extra positive feedback path is introduced into the latch comparator, which improves the response speed and reduces the power consumption. The input of the latch comparator is isolated from the latch structure, which reduces the effect of kick back noise and improves the accuracy of the comparator. The comparator is designed and simulated based on SMIC 0.18 渭 m CMOS process. The simulation results show that the accuracy of the comparator is 50 渭 V, the transmission delay is 458 pss, the power consumption is 432 渭 W, and the chip area is only 0.009 mm / 2 under the 1.8 V power supply voltage of 800MHz clock.
【作者单位】： 桂林电子科技大学广西精密导航技术与应用重点实验室;
【基金】：国家自然科学基金资助项目(61161003,61264001,61166004) 广西自然科学基金资助项目(2013GXNSFAA019333) 广西桂林电子科技大学研究生科研创新项目(YJCXS201519)
【分类号】：TN792

【参考文献】

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【共引文献】

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【二级参考文献】

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本文编号：1917674