一种基于时间交织流水线架构的高速ADC设计

发布时间：2018-07-07 07:02

  本文选题：模数转换器 + 宽带　； 参考：《现代雷达》2017年05期

【摘要】：伴随着宽带雷达系统的发展,信号带宽越来越大,从而对模数转换器(ADC)的转换速度要求也越来越高。为满足宽带系统需求,需要ADC能够在数百兆甚至上GHz转换速度下实现较高精度的数据转换,这对ADC芯片设计提出了很高的要求。基于0.18μm Bi CMOS工艺,设计了一种时间交织流水线架构的超高速ADC,前端采用一个超高速高精度跟踪保持器,转换核心采用四路并行流水线时域交织工作,内部集成多相位时钟控制电路。实测结果表明:该ADC芯片在800 MS/s速度下性能良好,部分通道最高工作速度可达1.2 GS/s。
[Abstract]:With the development of wideband radar system, the signal bandwidth becomes larger and larger, and the conversion speed of ADC becomes higher and higher. In order to meet the requirement of wideband system, ADC is required to realize high precision data conversion at several hundred megabit or even up GHz conversion speed, which puts forward a very high requirement for ADC chip design. Based on 0.18 渭 m Bi CMOS process, an ultra-high speed ADCC with time interleaving pipelined architecture is designed. The front end uses an ultra-high speed and high precision tracking holder, and the conversion core uses four parallel pipelined time domain interleaving. Internal integrated multi-phase clock control circuit. The experimental results show that the ADC chip has good performance at 800 MS / s speed, and the maximum operating speed of some channels can reach 1.2 GS / s.
【作者单位】： 南京电子技术研究所;
【分类号】：TN792

【参考文献】

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【共引文献】

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【二级参考文献】

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