一种采用双层仲裁机制的新型总线仲裁器

发布时间：2019-06-13 15:26

【摘要】：随着系统芯片复杂度的持续提升,不断增加的带宽需求和不可预测的线延迟使总线逐步成为提高系统芯片性能的瓶颈.总线仲裁器对系统芯片的性能起决定作用,所以对高效仲裁器的研究具有重要意义.鉴于仲裁器赋权的决策由不依赖硬件结构的仲裁算法确定,所以创建了一种验证仲裁器性能的软件仿真平台,并利用该仿真平台设计了一种基于双层仲裁器结构和层间判断的新型仲裁器.仿真结果表明,新型仲裁器实际赋权的比例与目的带宽比之间的均方差比两款传统仲裁器的分别降低了54.4%和50.8%,实现了赋权比例与目的带宽比的逼近.
[Abstract]:With the continuous improvement of the complexity of the system chip, the increasing bandwidth requirements and unpredictable line delay make the bus gradually become the bottleneck to improve the performance of the system chip. Bus arbiter plays a decisive role in the performance of system chip, so the research on efficient arbiter is of great significance. Since the decision of arbiter weighting is determined by arbitration algorithm which does not depend on hardware structure, a software simulation platform is established to verify the performance of arbiter, and a new arbiter based on double-layer arbiter structure and interlayer judgment is designed by using the simulation platform. The simulation results show that the mean square error between the actual weighting ratio and the destination bandwidth ratio of the new arbiter is 54.4% and 50.8% lower than that of the two traditional arbiters, respectively, and the approximation between the weighted ratio and the destination bandwidth ratio is realized.
【作者单位】： 西安电子科技大学微电子学院;
【基金】：国家自然科学基金资助项目(61474087)
【分类号】：TN47

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本文编号：2498614