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高压工艺新型ESD器件及全芯片保护研究

发布时间:2020-05-29 06:33
【摘要】:高压(high-voltage,HV)集成电路已经广泛应用于开关电源、电源管理、汽车电子产品以及驱动电路等应用上,这使得越来越多便携式消费类电子产品普及。在高压集成电路中,静电放电(electrostatic discharge,ESD)防护能力已经作为评估产品可靠性的重要指标之一。在高压集成电路中,硅控整流器(SCR)成为人们研究的热点。在ESD应力下,双载流子注入效应和SCR寄生的NPN管和PNP管的正反馈机制使SCR获得很低的维持电压,这将会导致它作为电源(VDD)到地(GND)间的钳位电路(power-rail clamp circuit)使用时容易发生闩锁(latch up)。目前,增加ESD器件的抗闩锁能力的一种方法是增加触发电流或维持电流大于发生闩锁效应最小的触发电流,另一种是增加其维持电压(V_h)大于集成电路的工作电压(VDD)。本文主要的内容如下:在本论文中,从传统CMOS工艺ESD基本防护器件和高压ESD基本防护器件的特性对比研究入手,分析了高压ESD器件鲁棒性很弱的原因以及高压IC静电保护存在的困难和挑战。基于0.18-μm BCD和12V BJT两种不同的高压工艺,通过仿真和流片测试手段,进行器件级和电路级的ESD防护设计研究。首先,介绍了ESD相关的三种物理测试模型和两种特殊测试评估模型;分析了四种ESD防护基础器件特性;介绍了之前的抗闩锁效应的四种器件类型。其次,本论文根据高压ESD防护器件的设计窗口和Kirk效应对高压ESD保护器件的影响,研究了BCD工艺下的NLDMOS器件,并利用嵌入SCR的方法减小由Kirk效应导致的弱鲁棒性问题。提出了一种自触发堆叠硅控整流器(Self-triggered stacked silicon-controlled rectifier structure,STSSCR),它采用堆叠方式实现闩锁效应高免疫能力并得到成功验证,该器件包含一个MLSCR和多个DTSCRs,随着堆叠数目增加保持触发电压基本不变且能有效地提高维持电压。最后,本论文探讨了在实际工程应用的电路级高压ESD全芯片防护,要满足两两引脚之间都存在静电放电通路,需要利用总线的方法构建ESD保护网络。从分析高压12V BJT工艺特点入手设计了不同应用要求的ESD单体器件,再根据高压IC的端口电路,将满足要求的单体器件接入电源轨总线,提出全芯片ESD保护方案,并进行流片和测试。
【图文】:

芯片,相关事件,半导体芯片,硕士学位论文


电子科技大学硕士学位论文第二章 ESD 保护的基础理论2.1 ESD 的概念静电放电(ESD)是一种最普遍的威胁半导体芯片的可靠性问题。ESD 事件是指有限的电荷从一个对象(如人体)转移到另一个对象(即芯片)的过程。这个过程在很短的时间内会产生非常高的电流通过芯片,因此超过 35%的芯片损坏可以归因于 ESD 相关事件。在半导体行业设计片上 ESD 结构去防止集成电路的 ESD应力损坏已经是一个高优先级的措施。图 2-1 显示了芯片上四种受 ESD 应力损坏的例子,从左上角开始为金属线熔断,金属接触破坏,晶体结构改变,,结损坏。

示意图,人体,示意图,机器模型


图 2-2 人体放电示意图 2.2.2 机器模型 MM同 HBM 相比较,机器模型是模拟一充电的机器臂、测试夹具或者任何其他类放电示意图。一般 MM 测试模型有一个这个电容直接进入测试设备通过 500nH 试模型的等效电路图。图 2-4 机械放电示意图
【学位授予单位】:电子科技大学
【学位级别】:硕士
【学位授予年份】:2018
【分类号】:TN405

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本文编号:2686546

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