基于UVM的一种总线监控电路的验证技术研究

发布时间：2017-08-19 00:36

  本文关键词：基于UVM的一种总线监控电路的验证技术研究

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【摘要】：芯片设计复杂度不断加大,验证在研发周期中占据着比设计更多的工作量,同时由于研发速度加快,芯片研发周期不断缩小,有效缩短验证时间、提高验证效率成为芯片研发的重中之重,亦成为亟待解决的问题,受到业界的高度重视。基于此,本文重点研究基于UVM的一种总线监控电路的验证技术。基于对总线监控电路验证的需求分析及不同应用场景,制定了总线监控电路的验证策略和验证方法,完成了验证平台的逻辑结构设计。借助sequence机制、phase机制等UVM关键技术,使用System Verilog验证语言设计了序列发生部件、驱动器部件以及监控器部件等验证单元,验证单元集成的验证平台可将测试激励的产生与驱动分离,减少了验证平台出错的几率,实现了激励注入、验证结果对比打印、验证环境自动运行、待测设计的行为精确控制等功能。依据总线监控电路的功能点分布及提取结果,设置了基本资源测试、总线监控消息轮询功能测试以及详细功能测试等四类共计102条验证用例。使用定向数值测试与随机测试相结合的方法对总线监控电路仿真验证,自动生成覆盖率报告,报告分析结果表明,总线监控电路的验证平台功能正确,设计符合要求。总线监控电路的功能覆盖率达到了100%,代码覆盖率达到了97.03%,达到了验证所要求的指标。相比传统验证平台,验证用例的设置减少了30%,验证时间减少了约20%,本验证平台可复用到系统级或其他子系统的验证平台,可有效地减少验证时间,提升工作效率。
【关键词】：UVM 验证方法学 Syetem Verilog 验证平台
【学位授予单位】：西安电子科技大学
【学位级别】：硕士
【学位授予年份】：2016
【分类号】：TN407
【目录】：

• 摘要5-6
• ABSTRACT6-11
• 缩略语对照表11-14
• 第一章 绪论14-20
• 1.1 选题背景及意义14-15
• 1.2 验证技术发展及现状15-18
• 1.2.1 验证方法学发展现状15-17
• 1.2.2 验证语言发展现状17-18
• 1.3 论文主要工作及内容安排18-20
• 第二章 UVM关键技术分析20-28
• 2.1 UVM树形结构20-21
• 2.2 UVM的类21-23
• 2.3 sequence机制23-24
• 2.4 phase机制24-26
• 2.5 factory机制26-27
• 2.6 本章小结27-28
• 第三章 总线监控电路的UVM验证平台设计28-56
• 3.1 总线监控电路验证的需求分析28-30
• 3.2 总线监控电路验证方案30-34
• 3.2.1 验证的策略30-33
• 3.2.2 验证平台逻辑结构33-34
• 3.3 验证平台单元设计34-53
• 3.3.1 事务级数据部件设计34-39
• 3.3.2 序列发送器部件设计39-43
• 3.3.3 驱动器部件设计43-45
• 3.3.4 监控器部件设计45-46
• 3.3.5 代理器部件设计46-48
• 3.3.6 接口设计48-49
• 3.3.7 参考模型设计49-51
• 3.3.8 记分板设计51-53
• 3.4 验证平台集成53-54
• 3.5 验证用例创建54-55
• 3.6 本章小结55-56
• 第四章 仿真验证与报告分析56-70
• 4.1 验证功能点设置56-57
• 4.2 基本资源测试57-58
• 4.3 总线监控消息轮询功能测试58-62
• 4.4 总线监控详细功能测试62-66
• 4.5 覆盖率报告66-68
• 4.6 本章小结68-70
• 第五章 总结与展望70-72
• 5.1 总结70-71
• 5.2 展望71-72
• 参考文献72-74
• 致谢74-76
• 作者简介76-77

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本文编号：697714