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接口时序一致性连续定量监测技术研究

发布时间:2021-08-15 13:33
  为了解决电气系统接口时序一致性的长期连续定量监测问题,设计了一种基于对比测试的时序一致性监测系统;该系统通过建立时序参数的描述模型,将时序约束统一为约束矢量并通过图形化界面输入,约束矢量包含时序参数的测点及约束条件;将理想时序周期内同一事件下各信号的逻辑值编为事件码并按事件先后顺序排列,以事件码序列为码型触发的模式序列,基于设计的DEW-BM算法捕获与模式序列匹配的目标数据序列,并计算其中各时序参数的测量值,通过验证测量值是否满足约束不等式给出接口时序一致性的监测结果 (Pass/Fail);系统最多可实现对16路信号的同步测量与分析,单通道最大采样率为20MHz;测试结果表明,监测系统能够正确捕获目标信号,时序一致性分析结果与理论期望结果一致,监测系统具有一定的正确性和通用性。 

【文章来源】:计算机测量与控制. 2020,28(05)

【文章页数】:6 页

【部分图文】:

接口时序一致性连续定量监测技术研究


对比测试基本流程图

结构框图,监测系统,结构框图,逻辑分析


本文基于虚拟逻辑分析仪结构设计时序监测的硬件系统,如图2所示;利用DSLogic逻辑分析仪模块实现接口信号数据采集及阈值比较,其性能参数如表1所示;通过USB总线接收数据流并以二进制文件存储到服务器硬盘。基于B/S架构设计时序分析软件,如图3所示,通过读取数据文件和输入被测参数信息进行时序一致性检测,并在前端页面显示时序一致性分析结果。

流程图,时序分析,流程图,一致性


基于B/S架构设计时序分析软件,如图3所示,通过读取数据文件和输入被测参数信息进行时序一致性检测,并在前端页面显示时序一致性分析结果。2 关键技术研究及设计

【参考文献】:
期刊论文
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博士论文
[1]时间序列模式匹配技术研究[D]. 张勇.华中科技大学 2012

硕士论文
[1]示波器串行总线协议分析软件包开发[D]. 刘悦.哈尔滨工业大学 2016
[2]逻辑分析仪串行总线协议分析模块设计[D]. 赖建钧.电子科技大学 2014



本文编号:3344644

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