基于多DSP的航迹规划系统硬件平台设计与实现

发布时间：2021-11-15 02:18

　　作为任务规划系统核心功能,航迹规划对提高精确制导武器的突防能力,实现对目标的精确打击起着重要作用。如何提高航迹规划的速度是当前航迹规划研究的重要课题之一。为提高航迹规划的速度,可以从两方面着手,一方面是从航迹规划算法入手,通过对航迹快速算法的研究提高航迹规划算法的效率;另一方面是提高航迹规划系统硬件平台的性能。本文主要对航迹规划系统硬件平台进行讨论,设计了基于三片DSP（TMS320C6455）的航迹规划系统硬件平台,主要包括以下几部分内容:根据航迹规划系统数据密集型特点对主要芯片进行了选型,在选定芯片型号基础上,讨论了多DSP互连方案,最终确定了硬件平台的具体系统方案。完成了硬件平台各个模块的设计,包括PCI总线和千兆网对外接口的设计,DDR2 SDRAM,Flash和I2C EEPROM存储扩展设计,EMIF和McBSP互连设计以及FPGA核心电路、电源、时钟、监控和复位电路、JTAG接口设计等。并在高速电路设计理论指导下完成了系统硬件平台PCB设计。提出了基于总线仲裁的新型多DSP对等全互连结构,该方法结构简单,数据传输灵活,多个DSP地位平等,不分主从。总线仲裁及通信协议由FP... 

【文章来源】：华中科技大学湖北省 211工程院校 985工程院校 教育部直属院校

【文章页数】：74 页

【学位级别】：硕士

【部分图文】：

TMS320C6455的整体结构框图

9图 2.2 C64x+内核模块框图C64x+ 的 两 个 数 据 通 路 是 一 个 完 全 对 称 的 结 构 ， 每 个 数 据 通 道.S、.M、.D 四个功能单元和一个包括 32 个 32 位寄存器的寄存器组。.M门的乘法运算单元。.S 和.L 单元执行运算、逻辑和分支等功能。.D 单元据的存取操作。这八个功能单元都能够在单时钟周期完成一条指令。A 和用寄存器组分别包含 32 个 32 位的寄存器。这些寄存器可用于存储 8 位、、40 位和 64 位数据格式的数据。对于大于 32 位的数据用寄存器组的方两个数据通道的 4 个功能单元的操作数之一都可来自另一侧的寄存器组数据通路的交互。C64x+数据通路结构如图 2.3 所示。

10图 2.3 C64x+内核数据通路C64x+内核对 C64x 内核的功能单元进行了扩展，同时还增加了一些新的处理能力大大提高。C64x+对.M、.L、.S 功能单元都进行了功能扩展。对单元，除了能完成 C64x .M 功能单元能完成的工作外，它还能在单时钟周

【参考文献】：
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博士论文
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本文编号：3495827