多核处理器片上可重构Cache系统及其机制设计

发布时间：2017-08-06 18:04

  本文关键词：多核处理器片上可重构Cache系统及其机制设计

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【摘要】：针对多核处理器规模化数据访存与并行线程交叉数据使用的特性,提出了一种可重构Cache的设计方案,包含其基本硬件逻辑结构和工作机制;同时提出了一种可在线动态重构Cache结构配置字生成的DCAC配置方法。实验证明,上述设计方案配合在线配置方法工作,能有效实现多核处理器系统根据不同的应用实时地配置共享Cache的组相联度,使得近处理器内核的Cache系统有效提升了命中率,在硬件开销增加4.07%的情况下,缺失代价平均下降约16.13%,从而达到了多核处理器性能优化的目标。
【作者单位】： 上海交通大学电子信息与电气工程学院;
【关键词】： 多核 可重构 Cache 配置 缺失代价
【基金】：国家自然科学基金项目(61176037)
【分类号】：TP332;TP333
【正文快照】： 1引言随着集成电路工艺的不断提高,出现了高性能多核系统结构.多核处理器往往具备拥有多核运算引擎的特点.典型的多核处理器中,多个运算核通过统一调度,并且通过统一的寻址方式来共享主存,即其具有线程级并行任务执行的特征.而随着片上处理器内核的个数不断增加,使得存储器的

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