基于全加器的逻辑判别电路设计

发布时间：2017-09-01 11:26

  本文关键词：基于全加器的逻辑判别电路设计

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【摘要】：全加器是实现算术加法运算的基本器件,常规使用是构成1位或多位二进制数算术加法运算电路。本文探讨了对全加器进行逻辑功能扩展的方法,目的是探索全加器进行非常规使用改变应用方向的逻辑设计技术,即用多个一位全加器组合、连接构成对多个输入量算术加运算电路,输入变量中1的个数不同,相加的结果也就不同,在相加结果的基础上再进行多数表决、奇偶数判别等逻辑判别电路的设计。所述方法的创新点是提出了全加器改变应用方向的逻辑设计方法。
【作者单位】： 渤海大学实验管理中心;
【关键词】： 全加器 逻辑判别 设计原理 Multisim
【基金】：2014年辽宁省高等教育教学改革研究A类项目(辽教发[2014]123号)
【分类号】：TP332.21
【正文快照】： 全加器是实现算术加法运算的基本器件[1-2]。数字逻辑电路中的多数表决、奇偶数判别等逻辑判别电路的逻辑关系,本质上是输入变量取值中1的个数不同产生不同的输出。用多个一位全加器组合、连接,构成对多个输入量算术加运算电路,输入变量中1的个数不同,相加的结果也就不同。在

【参考文献】

中国期刊全文数据库 前1条

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【共引文献】

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2 任骏原;;基于555定时器的同相输出施密特触发器[J];电子设计工程;2015年08期

【二级参考文献】

中国期刊全文数据库 前6条

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【相似文献】

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本文编号：771805