基于CPLD的自适应高精度时统模块设计
本文选题：时统模块 切入点：高精度 出处：《计算机测量与控制》2014年09期
【摘要】：通过分析影响时统模块自守时精度的因素,给出传统时统模块自守时精度低的原因,提出了基于CPLD的自适应高精度时统模块的硬件设计和CPLD逻辑设计方法;通过仿真及实际测试结果表明,基于CPLD的自适应高精度时统模块的自守时时钟与参考时钟的误差每小时小于3.6 ms,并且根据自守时精度的数学模型,通过提高晶振的频率可以提高模块的自守时精度。
[Abstract]:Based on the analysis of the factors that affect the self-punctuality precision of the timing system module, the reasons for the low self-punctuation accuracy of the traditional timing module are given, and the hardware design and CPLD logic design method of the adaptive high-precision timing module based on CPLD are proposed. The simulation and actual test results show that the error between the self-punctuation clock and the reference clock of the adaptive high-precision timing module based on CPLD is less than 3.6 Ms per hour, and according to the mathematical model of the self-punctuality precision, By increasing the frequency of the crystal oscillator, the self-punctuality accuracy of the module can be improved.
【作者单位】： 江苏自动化研究所;
【基金】：国家自然科学基金(61303045) 江苏省自然科学基金(BK2012237)
【分类号】：P127.1;P228.4
【参考文献】
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本文编号：1674497
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