基于本振移相方案的有源相控阵接收组件研究
【学位单位】:东南大学
【学位级别】:硕士
【学位年份】:2018
【中图分类】:TN958.92
【部分图文】:
第二章 相控阵天线接收组件其他芯片均作为待同步的从芯片。此时配置的主芯片能够在 SYNC_OUT为四分之一系统时钟频率并且脉冲宽度与一个系统时钟相等的脉冲,将该片的 SYNC_IN 管脚,从芯片在自动同步模式时会将 SYNC_IN 管脚输入内部四分频信号进行比较。若信号相位与主设备不同,从芯片内部会自动时钟周期,实现其系统时钟四分频信号的 90°移相,直至从芯片和主芯片9959 的芯片数据手册提供出如图 2-6 所示的利用 AD9510 芯片进行同步的路中,利用 AD9510 为不同的 AD9959 芯片提供相同的输入时钟频率,同输出的 SYNC_OUT 信号利用 AD9510 精密延时,同相的分配给不同从_IN 管脚。由于 AD9510 芯片所能提供的精密延时通道数目较少,从芯片制。
图 2-7 利用异或门实现 DDS 芯片同步电路2-7 所示,本文提出的本振移相的有源相控阵接收组件共使用了 4三片异或门芯片进行同步。同步过程中,两两信号对比,在对两时,要求将这两个芯片的 SYNC_CLK 管脚等长布线至异或门的对信号同步带来的影响。时钟信号经异或门比较后将输出电压发化为数字信号。若两输入信号同相,则经过异或门比较后,输出输入信号存在相位差,则异或门输出高电平。利用单片机循环判信号为高电平,则利用手动软件同步,向 I/O_UPDATE 管脚发K 完成 90°的相移,直至异或门输出的比较信号为低电平时,芯片方式,4 片 DDS 芯片两两同步,直至所有异或门输出电压为低。方案的相位分辨率中采用的AD9959芯片是相位分辨率位数M为14位的DDS芯片, PLL 是利用 25MHz 输入参考频率设计输出 10.6GHz 的本振信号0.6GHz 和 25MHz 的比值。若直接利用 DDS 输出 25MHz 的参考噪声的恶化后整机相位分辨率理论值为:
MGF4941噪声、增益与偏置电流的关系
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本文编号:2891767
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