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基于SRIO的高速射频信号存储系统的开发

发布时间:2021-08-07 07:03
  为满足CSNSRCS射频系统对短时间内大量射频信号数据记录和存储的要求,开发了基于PCI Express总线和Serial RapidIO互联通信技术的高速射频信号传输与存储系统。系统采用Xilinx FPGA作为主控制器实现协议包的解析、数据的DMA传输和动态缓存,再配合高速的SSD固态硬盘能够实现高达2 GB/s的数据传输和写磁盘存储速率。 

【文章来源】:核电子学与探测技术. 2020,40(01)北大核心

【文章页数】:6 页

【部分图文】:

基于SRIO的高速射频信号存储系统的开发


图1射频位号控制与监控平台整体的硬件架构??PCI?Express光纤通信卡通过Xilinx??-2?PCI?Express光纤通信程序的设计??

程序图,接收模块,数据包,光纤通信


GTX通道来实现两路4x?SRIO接口,接收由??光纤传输过来的数据。同样8x?PCI?Express??接口由相邻bank的两个Quad的8个GTX通??道来实现的。??2.2程序的整体架构设计??FPGA程序采用分层模块化的结构,根据??数据流的方向分为数据包的接收模块、包格式??解析模块、数据缓存模块、AXI内存映射接口??控制模块和PCI?Express数据流模块,如图2??所示。??<snur??4xsmn-??S〇mr.<,地址??数据包的接收模块??—g??^^??Seri.il?RapidIO?Gen2??Endpoinl?IP核??包格式解析模块_??AX14-Slmim??数据包的接收模块??写数据??T^lull??S*'rial?RapicilO?(icn2??Eli山x>inf?IP核??包格式解析模块??|[)&写地址??empty??^lll'O??^?:??—?????FIFO_N^M-l??数据缓存模块??读地址??MICi?略??AX14内存映射??接口控制校块??JL??AXI?Interconnect?II*核???AXI4?Memor>?Mapped??I??DMA?Subsystem?for??PCI?Express?IP^;??PC]?Express数据流模块??图2?PCI?Express光纤通信板FPGA程序的整体架构??2.3数据包的接收模块??存储系统通过2路4x?SRIO接口?SRIO接??收低电平控制系统中射频信号控制与处理系统??发送过来的SRIO数据包。程序的数据包的接??收模块采用Xilin

程序流程图,中断服务程序,程序流程图,文件


s?IP?核驱动,??通过8x?PCI?Express接口读取缓存到DDR3??内存中的数据。IP核支持4路的H2C(Host??to?Card)和?4?路的?C2H(Card?to?Host)?DMA??引擎,本系统只使用了?C2H引擎,接口配置为??AXI4内存映射接口。??上位机程序发起C2H传输读取PCI??Express光纤通信FPGA板卡的数据,并以文??件的形式写人SSD固态硬盘中。程序可以分??为C2H传输发起部分和DMA传输完成后写??文件部分,程序流程图如图5所示。??开始)??rw??丧找设备,获取PCI?Exprt?s!??DMAC2H设备句柄??初始化C2H传输.包括读取??数据大小,分配buffer空间??是否获取A制信丨爸上输??创建C2H传输描述符??将描述符写入寄存器C2H?SGDMA?Descriplor??hm?Address?(?0x5080?)和寄介器C2HSGT)MA??Descriptor?Higli?Address?(?0x5084?)??将剩卜‘的描述符的数M,即传输的次数??写入寄存器C2H?Sf;T)MA?!>script?r??Adjacent?(?0x5088?)??将寄存器C2H?Channel?Con丨ro丨(0x1004?)??的hiu>置丨,使C2H引擎启动??读寄存器IRQ?Blwk?Channel?Inlerrup丨?Request??(0x2044),判断发送中断的C2H的通道??B、:寄符器C2H?Channel?SlaU丨s?(?Ox?丨044?)和奇存??5{i¥C2H?Channel?Com|)leled?Descr

【参考文献】:
期刊论文
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本文编号:3327319

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