应用于高速串行通信的部分响应均衡技术的设计与实现
本文关键词:应用于高速串行通信的部分响应均衡技术的设计与实现
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【摘要】:随着信息化时代的快速发展,人们对通信系统的带宽要求日益增加,作为减少码间干扰的主要措施,均衡技术得到了广泛的应用。其中,部分响应均衡技术因其可以有效实现更高速率串行通信,而越来越成为国内外的研究的热点。本文基于CMOS 0.18μm工艺设计实现了应用于1OGb/s高速串行通信中的部分响应均衡器。该均衡器采用两路过采样结构并结合信道固有的频率衰减特性,在接收端得到了双二进制信号,从而减小了高速串行通信中的带宽需求。为了进一步增强部分响应均衡器的性能,采用了高频峰化技术以及负载电阻和源极电容校准技术,以应对由于工艺角变化带来的延时偏差的影响。包括焊盘在内的芯片面积为0.835×0.715mm2,在1.8V电源电压下的功耗为224mW。后仿结果表明,本文设计的均衡器能够有效工作在1OGb/s速率下,并且获得超过70%的眼图张开度。本文设计的均衡器已经流片并进行了测试。为了实现整个通信链路的设计,本文还研究了双二进制均衡的预编码以及解码器结构,并完成了高速比较器的电路设计。在当前通信系统带宽不断增加的趋势下,本文研究的部分响应均衡器可以有效减轻信道带宽需求,从而大幅提高信号传输速率,具有实际应用价值。
【学位授予单位】:东南大学
【学位级别】:硕士
【学位授予年份】:2017
【分类号】:TN914
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,本文编号:1300452
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