基于全流程并行加速的改进数字下变频器设计

发布时间：2018-05-05 23:09

  本文选题：数字下变频器 + 坐标旋转数字式计算机　； 参考：《电子器件》2017年01期

【摘要】：针对宽带通信雷达探测系统中高速率数据处理难度较大的问题,设计了一种全流程并行化处理的高速率数字下变频器,混频模块采用并行化的流水线坐标旋转数字计算机(CORDIC)对来自A/D的高速采样数据进行分组处理,以降低单个通道的数据率;抽取滤波模块采用多相滤波器进一步将高阶卷积网络进行并行化分解,减少不必要的乘累加运算。实验结果表明:最大处理速率由原先的131 MHz提高到了255 MHz,改进设计利用现有硬件条件大幅度提高了处理速度,减少了通带内信号的衰减。
[Abstract]:Aiming at the difficulty of high rate data processing in the detection system of wideband communication radar, a high rate digital downconverter is designed, in which the whole process is parallelized. In order to reduce the data rate of a single channel, the mixed-frequency module uses parallel pipelined rotated digital computer Cordic to process the high-speed sampling data from A- / D. In the decimation filtering module, the polyphase filter is used to decompose the higher order convolution network in order to reduce the unnecessary multiplicative and accumulative operation. The experimental results show that the maximum processing rate is increased from the original 131 MHz to 255 MHz. The improved design can greatly improve the processing speed and reduce the attenuation of the signal in the passband using the existing hardware conditions.
【作者单位】： 河南职业技术学院电气工程系;安阳师范学院物理与电气工程学院;东南大学电气工程学院;
【基金】：国家青年基金项目(51407027) 河南省科技厅科技计划项目(142102210517)
【分类号】：TN773

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本文编号：1849679